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基于VGA显示的10路逻辑分析仪

于 2023-04-08 发布 文件大小:3.29 MB
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代码说明:

FPGA 的VGA显示应用。最大采样频率100M,共十个采样通道,存储深度为每通道1024位。带时间标线,显示区域可移动。最终将波形数据显示到VGA显示器上。用Quartus ii进行设计,仿真工作。最后可在开发板上进行硬件测试。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • uc1701x_SPI
    UC1701串行编程例子,是一个很好的控制LCD模块的C语言串行编程(UC1701 serial program)
    2013-05-31 19:22:19下载
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  • Verilog_add_div_multi_exp
    使用verilog写的32位浮点数加法模块、浮点数乘法模块、浮点数除法模块、浮点数指数模块。指数模块是综合前面三个例化成泰勒级数求指数,迭代次数(可设置)决定了精度。(Use verilog write 32-bit floating-point addition module, floating-point multiplication module, floating-point division module, the floating point number index module.Index module is a comprehensive index of the front three cases into Taylor series for calculating index, the number of iterations can be set to determine the precision)
    2020-12-18 09:49:10下载
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  • UC1608-24064
    UC1608 24064驱动 COG LCD驱动程序(UC1608 24064)
    2011-09-09 08:24:24下载
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    2020-06-28 14:00:02下载
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    说明:  通过verilog hdl语言实现RS编码器与译码器的设计(Verilog hdl language through the RS encoder and decoder design)
    2013-07-18 16:09:22下载
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  • 与旋转方向检测的 verilog 数字转速表
    这是一个完整的工作模块编码在 verilog 检测的旋转车轮的旋转速度。它也给旋转的方向。这可以在 fpga 板直接实施,此模块内还有一个特别的小模块,以生成测试信号的面积。所以你不需要连接一个车轮与旋转编码器来测试 speedo 米。这就是独一无二的关于此模块 !!!cheerz!! 享受
    2022-03-01 20:15:18下载
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  • UART串口协议HDL实现,可设波特率、停止位和奇偶校验等
    UART串口协议HDL实现,可设波特率、停止位和奇偶校验等。可以在此基础上添加FIFO,以及处理器读写控制等。
    2022-01-24 10:03:16下载
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  • HDB3modelsim
    HDB3编码通过verilog实现,通过modelsim仿真(HDB3 coding is implemented by Verilog and simulated by Modelsim)
    2020-06-18 05:20:02下载
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  • usbd_ucos
    说明:  基于ALINX AX7020硬件平台的USB-OTG通信程序。操作系统采用uCOS III v1.41,基本实现了双向USB2.0 块传输(Bulk Transfer)通信,zynq的PS端接收USB数据并回传至主机。经测试,主机端Window10系统采用libUSBK编程时,采用64字节的块时,传输速率可达210Mbps。zynq开发工具为Vivado2015.4,程序包中包含了全部的硬件和软件工程文档。(A USB-OTG communication project where an AX7020 platform is employed as USB device. The embeded operating system is uCOS III of version 1.41, and the FPGA toolchain is Vivado 2015.4. This project implements a full speed bidirectional USB2.0 bulk transfer. A test on Windows 10 host with libUSBK shows that the transfer speed is up to 201Mbps.)
    2020-09-09 09:38:02下载
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  • FPGA实现Jpeg压缩,和视频采集程序
    说明:  FPGA实现Jpeg压缩,和视频采集程序(Zynq - Main - register access Mio)
    2020-03-13 23:25:40下载
    积分:1
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