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随机计数的计数器Verilog代码

于 2023-06-09 发布 文件大小:109.11 kB
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代码说明:

Verilog代码随机计数器计数的随机数,根据要求,

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  • lcd1602_drive
    用Verilog实现1602的配置及功能。正确编译与实现(Realized by Verilog 1602 configurations and functions. Compilation and implementation of the right)
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  • abi123
    encoding and decoding of audio signal
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  • sp6ex5
    说明:  xilinx SP6系列的3-8译码器实现(Implementation of Xilinx SP6 Series 3-8 Decoder)
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  • LED
    按键控制数码管显示,从0到9显示,八位数码管(Button control digital tube display)
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    DDR3 控制器,axi4_full 模式, burst长度为16,应用于xilinx平台。(DDR3 interface controller, axi4_full working mode with burst length 16, can operate on the xilinx platform.)
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  • costas
    costas的verilog程序,包含乘法器,DDS,鉴相器,环路滤波器等模块(costas the verilog program, including multipliers, DDS, phase detector, loop filter modules)
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  • (15-7-2)BCH
    Verilog HDL 语言编写的(15,7,2)BCH编码和译码功能(Verilog HDL language (15,7,2) BCH encoding and decoding functions)
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  • xilinx_edk_9.2_crack
    xilinx edk 9.2 破解器/注册机(xilinx edk 9.2 crack)
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