DDS_signal_genarator
于 2013-12-23 发布
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代码说明：
这是一个利用verilog语言编写的信号发生器的例子，值得参考(this is a code about signal generator by VIERILOG LANGUAGE!)
下载说明：请别用迅雷下载，失败请重下，重下不扣分！
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