[verilog]dcfifo_256x32
于 2017-05-10 发布
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代码说明：
双时钟域FIFO(This is self-defined Dual-Clock FIFO, using logic lut resources. Dual-Clock FIFO, Depth: 256 Width: 32 USEDW: Y FULLL:Y EMPTY:Y)
文件列表：
[verilog]dcfifo_256x32.v,1285,2017-05-10
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