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6层电梯组态王.rar
6层电梯组态王.rar 6层电梯断开ｐｌｃ仿真，可正常运行，亲测／２０秒无呼唤自动关门
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基于QT5.6编写Echart动态交互示例（仪表盘）-修改版
在原有QT编写Echart动态交互示例（仪表盘）进行修改，满足基于Qt5.6版本进行运行
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蓝桥杯练习题库【全】
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基于FPGA的8b10b编解码verilog实现
本设计是采用EDA技术设计的一种8B /10B 编解码电路,实现了在高速的串行数据传输中的直流平衡。利用verilog HDL 逻辑设计语言，经过modelsim、quartus II的仿真和下载验证，实现其编码和解码的功能。该编解码电路设计大体上可以由五个模块构成，分别是默认编码模块、差异度计算模块、编码校正模块、并串转换模块、显示模块。采用Verilog HDL 描述、modelsim 10.2a 进行功能仿真、Quartus II 13.1 进行FPGA逻辑综合和适配下载，最后在Alter 公司的Cyclone IV E 的芯片EP4CE6F17C8 上实现并完成测试。资源包中附有
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TMS320F2837xD技术参考手册-中文Chinese(下)
TMS320F2837xD技术参考手册-第14章：增强型脉宽调制器(ePWM)TMS320F2837xD技术参考手册-第15章：高分辨率脉宽调制器（HRPWM）TMS320F2837xD技术参考手册-第16章：增强型捕捉(eCAP)TMS320F2837xD技术参考手册-第17章：增强型QEP(eQEP)TMS320F2837xD技术参考手册-第22章：Controller Area Network (CAN)TMS320F2837xD技术参考手册-第23章：通用串行总线（USB）控制器TMS320F2837xD技术参考手册-第24章：通用并行端口(uPP)TMS3
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2D FFT基于CUDA的并行处理，适用于复数到复数的2D FFT
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旅游网站的设计与实现（开题报告+外文翻译+文献综述） 这是我的开题答辩用的 通过
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jsp网上购物系统完整版
jsp网上购物系统完整版，采用MVC模式，功能齐全。
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