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02-5G核心网基础.pdf

于 2020-12-08 发布

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5G核心网基础，包括5G网络架构，5G基本概念及5G基本流程目录1.5G核心网网络架构2.5G核心网基本概念3.5G核心网基本流程Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page2Ae HUAWEI⑧目录1.5G核心网网络架构1.15G网络架构1.25G网络功能介绍1.35G网络架构特点1.45G网络接口及协议介绍Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page3Ae HUAWEI5G网络架构一参考点方式呈现NSSFN1UDMN22N12N10AMFN11SMFN1N1N4(RJAN5G非漫游架构Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Pace4Ae HUAWEI5G网络架构一服务化架构方式呈现NSSFNEFNREPCFUDMAFNssf NefNpcNLldNafNaustNamfNsmfAUSFAMESMEN2N4UE(R)ANN3UPFDN5G非漫游架构Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.PageAe HUAWEI4G/5G网络架构对比3GPP AAServerNSSFNREPCFUDMAFPCRIS2b-CNssf Nef NNIDdmNafHSDiametersxbsabUPGWPGW.NausfNamfNsmfDiameterGTP-CGTP-UAUSEAMPSMFMMSGWSxa SGW.SCTPGIPePDGeNBAPEPC UEUERANUPFDN4G网络架构5G网络架构Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page6Ae HUAWEI4G/5G网络架构对比IndividualGovernmentEnterpriseOTT⑦scEFDAMPED&BINGE ONBINGE ONsponsored Data SolutionQos Acceleration SolutionCellular loT SolutionRXRADIUSI baShUs11STxs11S1 MMERadiusRXS-CS1-LIS61MME GGSNTP-GWPCRF MME UGWHSS MME UGWCopyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page7Ae HUAWEI⑧目录1.5G核心网网络架构1.15G网络架构1.25G网络功能介绍1.35G网络架构特点1.45G网络接口及协议介绍Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page8Ae HUAWEI网络功能一AMFNSSFNERNRFPCFUDMAFNefNarfPcfpNudeNaustNamtNsmfAUSFAMSMFN2N4UE(RANUPFNEDN注册管理:连接管理,可达性管理,移动性管理,接入鉴权,接人授权合法监听●转发U和S间的SM消息转发U和SMSF间的SMS消息Copyright 9 2018 Huawei Technologies Co, Ltd, All rights reserved.Page9Ae HUAWEI

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RAM2-14For-Loop best Practices for HDL Code generation2-16MATLAB Loops2-16Monotonically Increasing Loop Counters2-16Persistent Variables in Loops2-17Persistent Arrays in Loops2-17Fixed-Point Conversion3Floating-Point to Fixed-Point Conversion3-2Fixed-Point Type Conversion and Refinement3-16Working with Generated Fixed-Point Files3-26Specify Type Proposal Options3-33Log Data for Histogram3-37Automated Fixed-Point Conversion3-40License Requirements3-40Automated Fixed-Point Conversion Capabilities3-40Code Coverage3-42Proposing Data Types3-45Locking Proposed Data Types3-47Viewing functions3-47lew1ariables3-48Istogram ...3-54Function Replacements3-56Validating Types3-57g Numerics3-57Detecting Overflows3-57Custom plot functions3-59Visualize Differences Between Floating-Point and Fixed-Point results3-61Inspecting Data Using the Simulation Data Inspector 3-67What Is the Simulation Data Inspecto3-67Import Logged Data3-67Export Logged data3-67Group signals3-67Run options3-68Create Report3-68Comparison Options3-68Enabling Plotting Using the Simulation Data Inspector 3-68Save and Load simulation Data Inspector Sessions3-68Enable Plotting Using the Simulation Data Inspector 3-70From the UI3-70From the Command Line3-70Replacing Functions Using Lookup TableApproximations·3-72Replace a custom function with a lookup Table3-73From the UI3-73i ContentsFrom the Command line3-81Replace the exp Function with a Lookup Table3-84From the ui3-84From the Command line3-92Data Type Issues in Generated Code3-94Enable the highlight Option in a MaTLAB CoderProject3-94Enable the Highlight Option at the Command Line... 3-94Stowaway doubles3-94Stowaway singles3-94Expensive Fixed-Point operations3-94Code GenerationCreate and set Up Your Project4-2Create a New Project4-2Open an Existing ProjectAdd Files to the project4-4Primary Function Input Specification4-6When to Specify Input Properties4-6Why You must Specify Input Properties4-6Properties to Specify4-6Rules for Specifying Properties of Primary Inputs4-8Methods for Defining Properties of Primary Inputs4-8Basic hdl code generation with the workflowAdvisor4-10HDL Code Generation from System Objects4-14Generate Instantiable code for functions4-19How to generate Instantiable Code for Functions4-19Generate Code Inline for Specific Functions4-19Limitations for instantiable code generation forFunctions4-19Integrate Custom HDL Code Into MATLAB Design.. 4-21Define the hdl. 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Delay to RAM7-3How To Enable RaM Mapping7-3RAM Mapping requirements for Persistent Arrays andSystem object PropertiesRAM Mapping Requirements for dsp. Delay Systemob7-6RAM Mapping Comparison for MATLAB Code7-8Pipelining7-9Port registers7-9Input and Output Pipeline registers7-9Variable pipelining7-9Register Inputs and Outputs7-10Insert Input and Output Pipeline registers7-11Distributed Pipelining7-12What is Distributed Pipelin7-12Benefits and Costs of Distributed pipelining7-12Selected Bibliograph7-12Pipeline matlab variables7-13Using the hdl Workflow Advisor7-13Using the Command Line Interface7-13Limitations of MatlAB Variable Pipelining7-13Optimize MatLAb loops7-15oop Streaming7-15Loop unrolling7-15How to Optimize maTLaB loops7-15Limitations for MaTLAB Loop Optimization7-16Constant Multiplier optimization7-17Specify constant multiplier optimization7-19Distributed Pipelining for Clock Speed Optimization7-20Map Matrices to Block RAMs to Reduce Area7-27Resource Sharing of Multipliers to Reduce Area7-32Loop streaming to Reduce Area7-41Contents

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