简易信号发生器 FPGA

代码说明：

说明：  简易信号发生器，可以实现简单的信号实现，任意波编辑，通过FPGA的verilog语言实现功能，自测可以正常使用。(Simple signal generator, can realize simple signal realization, arbitrary wave editing, through FPGA Verilog language function, self-test can be used normally.)

文件列表：

简易信号发生器 FPGA, 0 , 2019-05-20
简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832, 0 , 2019-05-20
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简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\CNT6.bsf, 2234 , 2007-07-20
简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\CNT6.vhd, 475 , 2007-07-20
简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\CNT7.bsf, 1590 , 2009-05-16
简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\CNT7.vhd, 475 , 2009-05-16
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简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\dataHEX\SDATA.LST, 6213 , 2004-12-02
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简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\db\SNGT.ipinfo, 243 , 2018-05-21
简易信号发生器 FPGA\EP17_SIN_WAVE_DAC0832\db\SNGT.sld_design_entry.sci, 555 , 2018-05-21
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