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FPGA数码管时钟显示

于 2022-03-18 发布 文件大小:1.22 MB
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代码说明:

FPGA时钟显示程序,可以按照正常的时间,频率可调,数码管显示00-00-00,中间的-可改。只要采用嵌套的循环结构实现

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • vga
    利用FPGA控制VGA显示器显示字符汉字的程序,里面有注释。(VGA display with FPGA control procedures Kanji characters, there are comments.)
    2013-11-25 11:59:13下载
    积分:1
  • AND
    this is "AND" gate implementation in VHDL
    2012-12-23 00:59:12下载
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  • xapp888
    说明:  xilinx fpga各版本mmcm/pll动态配置RTL代码,包括testbench(xilinx fpga mmcm/pll drp RTL code, including testbench)
    2021-01-21 21:38:46下载
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  • verification environment to verify synchronous FIFO
    -&同步FIFO的验证环境。
    2022-12-14 19:40:03下载
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  • MAX5250_Serial
    说明:  对MAX5250芯片进行控制,实现DA转换输出。(Controlling MAX5250 Chip)
    2019-06-27 14:19:36下载
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    在fpga下 ,完全用verilong编写的以太网程序,可以进行tcp/IP通信,请不要用在商业用途中,谢谢
    2022-10-05 04:20:03下载
    积分:1
  • fpga实例程序代码
    关于FPGA的一些例程,包括CORDIC数字计算机的设计,RS(204,188)译码器的设计等。(Some routines on FPGA include the design of CORDIC digital computers, the design of RS (204188) decoders, etc.)
    2018-07-21 19:08:25下载
    积分:1
  • 基于MIPS架构的CPU
    用Verilog写的基于MIPS架构的CPU,可以运行50多条指令,包括运算、分支、跳转、比较等指令,不过没有中断系统,大家可以考虑使用,我也是学校课程课设做的。。
    2022-05-05 02:18:27下载
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    APB 总线。可以实现单个数据在总机与从机之间的读写功能(This can achieve the read and write functions of a single data between the master and the slave .)
    2017-08-22 16:04:06下载
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  • verilog
    lap of altera . it s basic about verilog
    2010-06-25 20:30:32下载
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