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uart代码

于 2022-04-07 发布 文件大小:6.22 MB
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代码说明:

uart 串口 verilog 含testbench quartus工程 全双工 发送模块 接受模块

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  • SD-Host-Controller-master
    说明:  sd卡的verilog代码,包含一些sd卡例程(SD card Verilog code, including some SD card routines)
    2021-04-29 13:48:42下载
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  • 测试AD9280的功能,用verilog编写
    通过verilog编写AD9280的测试程序,将AD9280采集的数据存储到sdram中,然后读取sdram中的数据,发送到串口进行保存。
    2022-08-12 16:55:30下载
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  • RLS.v
    用verilog实现的一个2抽头RLS自适应滤波器的代码(A realization with verilog HDL code of a two-tap RLS adaprive fliter )
    2021-04-29 11:48:43下载
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  • 以太网控制器Verilog源码(含有MAC,MII接口)
    以太网控制器Verilog源码(含有MAC,MII接口)(Ethernet controller Verilog source code (including MAC, MII interface))
    2017-08-18 10:32:27下载
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    基于fpga的电子血压计。pdf文档,好用,内容清楚简单,转载而来(Electronic sphygmomanometer based on fpga)
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  • smartWasher
    QUARTER编程环境实现的智能洗衣机系统,通过DE0板子进行模拟,组要完成洗衣机5个步骤的顺序过程以及系统相应动作(QUARTER programming environment of intelligent washing system, through simulation DE0 board, groups 5 to complete the washing process and the system the sequence of steps corresponding action)
    2020-11-06 13:19:49下载
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  • ALU 的 MIPS 体系结构
    · 成功地设计并实现了基本块的 MIPS 包括 5 阶段管道、 拖延技术和数据转发。 · 设计并实施一个智能的调度程序,将帮助减少消费物价指数,受 1 时钟周期引起的负载和其下一条指令之间的数据依赖在拖延管道。 · 使用的工具: Verilog 的风投公司,设计视觉。
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  • FIFO
    用verilog语言的实现FIFO存储器,以先进先出的方式处理数据(The FIFO memory is implemented in Verilog language, and data is processed in FIFO)
    2017-07-15 09:33:21下载
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  • rake
    使用matlab实现cdma 系统的rake接收机,比较最大比合并,等增益合并和选择性合并接收算法的性能(脢 鹿 脫脙matlab脢渭脧脰cdma 脧渭脥 鲁 渭脛rake 陆 脫脢脮 禄煤 拢 卢 卤 脠 陆 脧 脳 卯)
    2021-04-19 14:38:51下载
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