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verilog实现同步FIFO模块

于 2022-07-19 发布 文件大小:3.66 MB
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代码说明:

“同步”表示相同频率的时钟源,“ FIFO”表示先进先出的意思。 FIFO 的用 意一般都是缓冲数据,另模块独立,让模块回避调用的束缚。同步 FIFO 是 RAM 的亚 种,它基于 RAM,再加上先进先出的机制,学习同步 FIFO 就是学习如何建立先进先出 的机制。

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