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verilog实现的RS译码器

于 2022-08-03 发布 文件大小:13.94 kB
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代码说明:

verilog实现的RS(204,188)译码器,包括各个模块详细的功能说明,已经通过仿真验证,亲测可用

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  • 4ASKmod2
    讲述4ASK的原理并附有matlab调制解调的源码。。。。。。。。。。 注:原来上传的4ASKmod.zip不要下(The principle tells 4ASK together with modulation and demodulation matlab source. . . . . . . . . . Note: The original upload 4ASKmod.zip not down)
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  • mancheshitebianjiema
    用VHDL编写的曼切斯特编解码,适用于以太网上流行的基带传输数字编码。(Manchester encoding and decoding written using VHDL, popular Ethernet baseband transmission of digital coding.)
    2012-05-25 15:16:35下载
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