ASK编码（Verilog通过，内含Testbentch）
于 2022-01-25 发布
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代码说明：
`timescale 1ns / 1ps ////////////////////////////////////////////////////////////////////////////////// //creat for the zedboard . //The AD used ADV7511. ////////////////////////////////////////////////////////////////////////////////// module ad( datain , clk , rst , dataout ); input [11:0] datain; input clk; input rst; output [11:0] dataout;
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