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数字钟,带调时加闪烁

于 2022-01-26 发布 文件大小:168.63 kB
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代码说明:

24小时计时,可调时间,调时时闪烁,同时输入调时信号去抖

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  • 华为 典型verilog 程序设计 大全
    本源代码集合,含有华为几十例经典的功能代码,经过反复的测试可以完美运行,不会发生代码上的错误,可以放心使用,希望有需要的人可以下下来参考一下
    2022-10-31 03:50:02下载
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  • CNT60
    六十进制计数器,显示0到60.可以用数码管显示。(Six decimal counter 0-60 can use the digital display.)
    2012-10-17 19:32:56下载
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  • 读写SDRAMd verilog代码
    很有用的SDRAM读写代码,上板验证有效
    2022-03-18 06:20:31下载
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  • FPGA_Turbo
    Turbo码编解码的FPGA实现,verilog语言编写(Implementation ofTurbo code on FPGA , using Verilog language)
    2021-04-19 09:48:51下载
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  • vhdl1008
    PCI slave IP core, in VHDL language ,has been verified,it is very easy to use. it is an ideal IP to study PCI,design PCI Bridge
    2020-06-18 18:20:01下载
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  • xiangmu_chengxu
    雷达基本恒虚警处理,CA-CFAR(单元平均恒虚警处理),OS-CFAR(有序类恒虚警处理),SO-CFAR(选小类恒虚警处理),(radar basic constant alarm operation,obtaining os-cfar,so-cfar,os-cfar,ca-cfar)
    2020-12-01 20:59:28下载
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  • spi_test
    基于fpga的spi通信测试 可与stm32进行spi通信测试(SPI communication test based on FPGA can test SPI communication with stm32)
    2020-06-20 21:00:01下载
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    吠陀乘数花更少的时间来执行使用的 URDHVA TIRYAKBHYAM 算法从吠陀 》 的乘法晒版程序自动完成。这个源代码是 4 X 4 吠陀乘数使用拟议的 4 位加法器
    2022-02-03 08:53:04下载
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  • rs_204_188----v1.0
    RS 编码和解码Verilog Code, 实现了RS(204,188)的编码和译码;(RS Coding and Decoding Verilog code, implement RS(204,188) )
    2021-03-25 20:29:14下载
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  • AHBtoAPB
    说明:  amba总线桥:ahb to asb!verilog hdl文档加代码,非常全,soc(amba bus bridge: ahb to asb! verilog hdl code for the document plus a very full, soc)
    2021-01-05 03:48:55下载
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