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康塔德7 0 - 9999 en显示segmentos verilog

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代码说明：

该项目利用NEXYS3（斯巴达6）董事会4显示器和它的编程verylog 启动白衣100 MHz的时钟和我们使用preescaler换下来的frecuency，非常有礼貌的观点

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利用正点院子开拓者fpga实现DDS功能
说明：利用正点院子开拓者fpga实现DDS功能，实现三角波、正弦波、方波的发生。(Implementation of DDS with FPGA)

2019-08-21 09:30:18下载

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BCH3
BCH3.c,提供m<21以下的所有码长的BCH编解码模块。以供大家参考。谢谢(BCH encoder&decoder GF(2^m) m<21)

2021-01-26 11:58:36下载

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FPGA_AD7822
基于FPGA的AD转换控制器设计，AD7822，quartus II，verilog hdl(A Design of the A/D Convertion Control Module Based on FPGA)

2011-08-26 15:06:18下载

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基于Verilog的FFT基四64点算法免费开源共享
基于Verilog的FFT基四算法，该代码实现64点，16位整型的FFT计算，基于Quartus II 13.0版本，工程文件已归类，方便移植。

2022-03-10 16:52:45下载

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1
说明：基于FPGA的USB接口设计，实现了USB与FPGA的通信(USB interface to FPGA-based design, implementation of the USB communication with the FPGA)

2011-02-21 15:50:27下载

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I2C verilog
I2C verilog files. Define a simple interface of I2C.After testing to ensure the using.

2022-01-31 11:40:44下载

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calculator_final
清华大学电子课程设计：Verilog，QuartusII可正确运行，可下载到FPGA上，音乐计算器，完成两个三位数的运算，有注释，很强大！！(Verilog, QuartusII run correctly, can be downloaded to the FPGA, music, calculator, completed two three-digit operations, there are notes, very powerful! !)

2020-08-16 23:38:25下载

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fir
vhdl code for fir filter

2011-02-18 11:51:26下载

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AHB_SMSS
ahb single master single slave rtl design

2021-04-21 11:28:49下载

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P4 (3)
支持{addu、subu、lui、ori、jal、jr、lw、sw、nop}指令集的单周期CPU，verilog硬件描述语言实现(Support {addu, subu, lui, ori, jal, jr, lw, sw, nop} instruction set of one-cycle CPU, Verilog hardware description language implementation)

2018-12-02 17:22:40下载

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