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FIR_filter
说明： 滤波器就是对特定的频率或者特定频率以外的频率进行消除的电路，被广泛用于通信系统和信号处理系统中。(Filter is a circuit that eliminates specific frequencies or frequencies other than specific frequencies. It is widely used in communication systems and signal processing systems.)
- 2020-06-21 14:00:01下载
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ahb_verilog_design
代码为ahb interface ，用verilog编写的,包括仿真和综合。(Code for the interface AHB, written in Verilog, including simulation and synthesis.)
- 2020-12-21 14:49:07下载
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AD9777_SPI_CONFIG
verilog ad9777 ad芯片的配置程序，SPI接口协议 16bit DA(Verilog ad9777 AD chip configuration program, SPI interface protocols for 16 bit DA)
- 2020-07-29 21:08:38下载
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i2c代码（简单读写1字节数据）
i2c代码 可以从eeprom中写入并读出一字节数据 并用led显示 已调试成功
- 2022-05-28 11:05:56下载
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VHDL
Project manager is reak vhdl old man
- 2015-09-10 10:06:28下载
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AES加密算法verilog源码
AES加密算法verilog源码
This project is the hardware implementation of the
Advanced Encryption Standard with a key size of 128 bits.
The implementation adheres to the FIPS-197 document which explains the same.The core can do both encryption as well as decryption.The documents aes_arch.doc and aes_tb_readme.txt give further details of the rtl implementation and test bench respectively. This code was written originally with 128 bit ports for both input and key but later converted to 64 bits each to save on i/o pins. It can be reverted back easily if one just changes the port widths and dispenses with the load signal in the top module and making approriate changes in process where load is used.Synthesis results have been included for Xilinx Spartan-3 device.The directory structure of the project is as under-
AES128
- 2023-05-16 03:30:03下载
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ov5620在FPGA中的使用
ov5620在FPGA中的使用，本程序实现的功能是驱动摄像头OV5620，并将数据通过VGA接口输出，外接显示器即
看到摄像头的图像。
- 2022-04-11 15:24:17下载
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整个工程代码
说明： 掌握SDRAM数据读写、刷新、初始化以及FPGA串口收发时序，熟练FIFO IP核的生成和调用。(Master SDRAM data read and write, refresh, initialization and the timing of sending and receiving of the serial port of the FPGA, skilled in the generation and invocation of the FIFO IP core.)
- 2019-01-21 17:21:27下载
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硬件和软件监测仪高级别系统对芯片验证
今天的系统芯片 （SoC） 验证发生在低的抽象级别，通常在寄存器传输级(RTL)。随着 SoC 设计的复杂性，它是越来越重要了，搬到较高抽象级别的验证。硬件/软件协同仿真是这一步方向，而是由于错误的处理器不足够型号和低速的硬件仿真速度。系统级监测，通常用于基于事件的软件调试，提供有关任务调度事件，任务间通信信息和， 同步信号量/资源、 I/O 中断等我们目前 MAMon1可以监测系统两个监视逻辑级和系统级的
单/多处理器片上系统。小硬件探测器单元集成在 SoC 设计中，并通过一个基于主机的监测工具环境的并行端口链接连接。探头装置在运行时，在目标系统中收集的所有事件和时间戳他们的分辨率为 1 s。事件然后存储在主机上的数据库进行进一步的处理。本文将叙述 MAMon 以及它适用于软件和硬件监控。本文还描
- 2022-03-19 20:43:24下载
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Verilog-detail
不错的verilog学习语言资料，详细地对verilog语言中的重要语句应用进行分析。(A good the verilog learn language information, verilog language statement application.)
- 2013-03-26 13:01:23下载
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