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fpga emif verilog

于 2022-02-21 发布文件大小:4.09 kB

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代码说明：

接口模块，通过对高位地址的编码可实现在一个FPGA中配置四个独立的功能模块，每个功能模块具有一个带FIFO的输出口和13个独立的可由DSP读写的寄存器，寄存器功能可自定义。模块还包含两个全局寄存器，可实现全局复位，中断等功能。该

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2012-05-14 15:36:09下载

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