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DLX-pipeline-in-verilog
verilog实现DLX指令集5段流水线(5 stage DLX pipeline implemented in verilog)
- 2013-08-24 22:59:48下载
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ad0809
对ad0809的控制代码( ad0809control)
- 2010-08-28 15:00:50下载
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中山大学计组实验--单周期CPU设计
中山大学计组实验--单周期CPU设计，实现12条指令，基于xilinx ISE 14.4 测试通过
- 2022-03-21 15:15:11下载
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CD1_PHOTO_ABLUM_1920
使用FPGA做的数码相册实验，用NIOS做了FAT32文件系统和JPEG图像解码,FPGA和SDRAM做了显示的缓存(Using FPGA to do the digital album experiment, using NIOS to do the FAT32 file system and JPEG image decoding, FPGA and SDRAM to do the display cache)
- 2016-07-13 10:04:56下载
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nseval
nseval - Object evaluation, includes control method execution.
- 2014-10-15 14:18:05下载
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Modulator70
个人参与的某国家工程并行排序MATLAB程序，用于FPGA的RTLAB仿真，使用Simulink工具生成HDL代码。测试可用。(Individuals involved in sort of a national engineering parallel MATLAB programs for the FPGA RTLAB simulation, using the Simulink tool to generate HDL code. Test available.)
- 2011-07-29 15:16:30下载
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自编同步串口收发，单端信号可实现板内，配合422或LVDS板间传输效果不错
自编同步串口收发，单端信号可实现板内，配合422或LVDS板间传输效果不错内附pingpang缓存接受的例程，帮助快速构建代码，FIFO请根据器件生成或自编
- 2022-11-19 12:40:04下载
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taxi
利用Verilog HDL语言设计了出租车计费器，使其具有时间 显示、计费以及模拟出租车启动、停止、复位等功能，并设置了动态扫描电路显示车费和对应时间，显示 了硬件描述语言Verilog—HDL设计数字逻辑电路的优越性。(Design using Verilog HDL language a taxi meter, it has time display, billing and simulation taxi start, stop, reset and other functions, and set dynamically display scanning circuit and the corresponding time fare, shows the hardware description language Verilog-HDL design advantages of digital logic circuits.)
- 2011-08-30 08:18:51下载
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DSP-keshe
设计题目：基于MATLAB的FFT算法的设计
设计内容：
所设计的FFT算法应完成以下功能：
（1）在MATLAB环境下编写FFT算法（不调用系统现有函数）；
（2）实现对选定图片进行FFT计算、还原（IFFT计算），并与系统FFT函数做对比，进行分析；
（3）设计GUI界面。
(Design topics: content based on the the MATLAB FFT algorithm design design: the design of the FFT algorithm should perform the following functions: (1) the FFT algorithm written in MATLAB environment (do not call existing function of the system) (2) to achieve the selected picture for FFT calculation, restore (IFFT calculation) system FFT function analysis (3) design GUI interface.)
- 2013-04-09 16:51:00下载
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ptos
八位并行数据转换为串行数据依时钟信号串行输出(Eight bit parallel data to serial data)
- 2018-05-02 19:43:25下载
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