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基于FPGA的串口通信程序设计

于 2022-03-22 发布 文件大小:3.34 MB
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代码说明:

本代码是一个基于FPGA的串口通信程序设计,程序采用Verilog语言编写,工程中已经加入了仿真模型,并设置了仿真,如果你的电脑也安装了modelsim-altera,就可以直接点击RTL仿真,就能出仿真结果了。程序的主要功能实串口测试,当FPGA芯片收到上位机发送的数据时将数据再发回到上位机,在串口助手上进行显示。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • gtwizard_254_127_ex_1113_3
    配置GTH ip的例子工程,选用7 series 芯片的GTH 113quad的四个通道,在程序中每个链路利用自己的恢复时钟进行数据解码,所以四个通道可以各自独立运行;成功工作在2.54Gb/s的链路状态,长时间(>24小时)的测试,误码率一直为0.(The GTH ip example project is configured with four channels of the GTH 113quad of the 7 series chip. Each link in the program uses its own recovery clock for data decoding, so the four channels can operate independently; the successful operation is at 2.54Gb/ The link state of s, long time (>24 hours) test, the bit error rate has been 0.)
    2019-06-17 21:33:56下载
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  • syn
    载波同步的verilog代码,是新手学习同步的最佳选择,值得推荐。(Verilog code carrier synchronization, synchronization is the best choice for novices to learn, it is worth recommending.)
    2021-01-08 09:48:51下载
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  • OFDM-analysis-and-simulation
    实现了光OFDM模块的各个功能,同时仿真分析了OFDM的载波幅度谱、相位谱、每个载波对应的时域信号、整个时域/频域的OFDM、每个接收符号的分布图。计算了相位差等等(To achieve the various functions of the optical OFDM module, the simulation analysis of the the the OFDM carrier amplitude spectrum and phase spectrum, and the time domain signal corresponding to each carrier, the whole time domain/frequency domain OFDM, each reception symbol maps. Calculated phase difference)
    2020-10-17 16:17:28下载
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  • apb_uart
    这里是apb总线设计代码。这个源程序是基于verilog语言设计的(Here is the APB bus design code. This source program is designed based on Verilog language)
    2021-04-12 14:18:57下载
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  • 加减法器
    可实现两个4bit补码的加法及减法,有溢出提示(adder with overflow hint)
    2017-07-19 20:52:42下载
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  • 32 bit shifter verilog fpga
    应用背景32 位数字移位器,可用于乘法器的实现关键技术32位数字移位器,采用查招标的方式,基于FPGA和Verilog语言
    2022-07-28 04:32:07下载
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  • ambe_rx_tx
    AMBE2000的压缩数据输出输入的Verilog代码,实现了自回环(loopback)效果. 希望对学习verilog语言的同学有所帮助。(The Verilog code of AMBE2000. input and output of compressed data to achieve a self-loop (loopback) effect. hope to help the one who is studying the verilog language.)
    2014-03-19 08:55:46下载
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  • pipline_lms_and_rls_verilog
    流水线LMS,和RLS算法的Verilog代码,用于自适应信号处理的FPGA实现。(The Verilog code about fir_pipline_lms and fir_rls. They commonly used in adaptive signal processing in FPGA platform.)
    2021-05-06 20:58:37下载
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  • CNTRTEST3_7tx_rx_0422
    在ISE12.4与TMS320F2812的XINTF接口,实现数据收发(In ISE12.4 TMS320F2812 the XINTF, data transceiver)
    2021-01-08 10:48:51下载
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  • 道路检测
    以Cyclon II 系列芯片EP2C35F672C6N 为核心的开发板,用verilog语言描述高速公路上汽车行驶的状态,检测t时刻高速公路上汽车行驶的是否在当前规定的车道内。
    2022-07-05 03:48:17下载
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