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AHB 总线协议

于 2022-03-23 发布 文件大小:41.69 kB
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代码说明:

AHB 主设备和从设备在 verilog 实施。在项目中定义的主要功能是: 所有类型的爆裂增量、 缠绕、 连续和非序贯、 流水线的交易。试验台进行了核查

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  • cfo_correction
    说明:  OFDM载波同步,Verilog编写,完全正确!!!(verilog )
    2020-11-05 21:39:50下载
    积分:1
  • color bar 彩色条纹的verilog实现
    使用verilog语言编写的colorbar输入,适合于用于图像采集系统的测试和验证用。
    2022-01-22 02:57:06下载
    积分:1
  • PRBS
    代码是伪随机数生成和检测的模块,用于通信行业的FPGA编程。包括VHDL和Verilog两种语言的版本。用于做接口测试。(This module generates or check a PRBS pattern.)
    2021-05-08 11:58:35下载
    积分:1
  • full adder
    说明:  vhdl code for full adder
    2020-06-30 22:46:55下载
    积分:1
  • scan_led
    FPGA扫描LED显示灯,动态扫描,进行流水显示(FPGA Scan LED indicator lights, dynamic scanning, make the water show)
    2015-02-16 18:02:16下载
    积分:1
  • LED-clock-display
    利用单片机控制LED时钟显示,以及闹钟,程序较大,但比较简单易懂。(LED clock display)
    2013-03-10 10:15:37下载
    积分:1
  • 自动计费机
    • 自动计费机 (ABM) 是银行信息亭提供给消费者 24 X 7. • 这些作为数据终端实现便捷的货币交易。 • 在这些无人值守的机器,用户不得不使用 ATM 卡 (卡与帐户信息),并提供个人识别号码 (PIN) 使用一个键盘。当计算机将验证该引脚时,客户获取选择的交易记录。 秉承指示并输入正确的选择,用户可以取款、 存款现金、 更改 PIN 或只是获取有关账户余额信息。
    2023-03-02 08:30:03下载
    积分:1
  • 8.8-URAT-VHDL
    URAT VHDL程序与仿真 URAT the VHDL program and Simulation (URAT the VHDL program and Simulation )
    2012-04-09 20:53:45下载
    积分:1
  • RISC
    说明:  RISC全部源码,包含仿真文件,使用makefile脚本编写,能通过vcs编译(RISC all source code, including simulation files, using makefile script, can be compiled through VCS)
    2020-04-14 22:10:52下载
    积分:1
  • FPGA
    verilog编写的QPSK发射机的FPGA部分,已经过验证,完全达到要求。调制矢量误差4%(QPSK transmitter verilog prepared by the FPGA portion, has been proven, fully meet the requirements. Modulation vector error of 4 )
    2013-10-08 14:58:23下载
    积分:1
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