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UART Verilog sorce 代码和仿真代码和 FIFO 代码

于 2022-03-24 发布 文件大小:1.09 MB
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代码说明:

它由 verilog 语言编程和主要代码是 UART,主要来源代码是 uart_receiver.v /uart_transmitter.v/lpm_mux0.v/myfifo.v......一些波形文件可以帮助您了解更多的模拟信息。

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  • uartfifo使用fifo进行uart通信
    使用verilog HDL语言进行编写,通过FIFO缓存,使用uart串口,与上位机进行通信。在本示例中,FPGA向上位机发送的数据每次加一,并在串口调试助手中显示,可以观察相关现象。
    2022-02-21 18:02:35下载
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  • 含有FIFO的串口发送模块-发送字符串VerilogHDL
    本资源是基于FPGA的一个硬件串口模块设计,其中包括的模块有:datagene.v,uart_speed_select.v,fifo_232.v,uart_ctrl.v,uart_tx.v,uartfifo.v,其中uartfifo.v为顶层模块,它调用上述的一些模块,完成相关的功能,本设计主要实现的功能是串口的字符串发送。不是简单的单字节发送,而是完成字符串的发送。
    2022-02-16 06:13:18下载
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  • SD-Host-Controller-master
    说明:  sd卡的verilog代码,包含一些sd卡例程(SD card Verilog code, including some SD card routines)
    2021-04-29 13:48:42下载
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  • Actel8051Core
    Actel 8051 Verilog core
    2020-06-27 03:00:02下载
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  • Verilog HDL程序LDPC编码器
    LDPC编码的Verilog HDL程序源代码,包括仿真数据等,内容比较全,用quartusII仿真的。
    2022-07-25 21:52:30下载
    积分:1
  • second7-02
    在quartusII环境下采用对编解码芯片HD6408和HD6409驱动的方式实现曼彻斯特编解码(Environment in quartusII codec chip used on the HD6408 and HD6409-driven way to achieve encoding and decoding of Manchester)
    2020-11-02 10:19:53下载
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  • AD9764
    一个AD9764的基于FPGA的驱动,希望对有需要的朋友有所帮助(An AD9764 FPGA-based drive, we want to help a friend in need)
    2013-09-05 01:48:57下载
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  • clock18div
    Clock Divider, divfactor of 18
    2015-03-24 18:04:49下载
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  • SRIO-phy-code
    SRIO接口物理层的实现代码,非常复杂,完全自己用verilog编写,支持5G速率,可以作为开发参考(SRIO interface implementation code, the physical is very complex, completely written in verilog, support rate of 5 g, will be helpful to the development)
    2020-10-01 11:57:42下载
    积分:1
  • ad0809
    对ad0809的控制代码( ad0809control)
    2010-08-28 15:00:50下载
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