登录
首页 » Verilog » 4 位超前进位加法器的设计

4 位超前进位加法器的设计

于 2022-03-24 发布 文件大小:11.23 kB
0 123
下载积分: 2 下载次数: 1

代码说明:

本文阐述了设计的 4 位携带看前方 adder.this 加法器是比较会波及进位加法器的高速度。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • sqrt_pipeline
    说明:  Matlab - to hdl code for square root
    2020-06-17 12:20:02下载
    积分:1
  • Verilog_code_for_AWGN
    说明:  verilog实现awgn信道噪声的代码,支持可变的信噪比。利用移位寄存器来实现伪随机序列。(verilog code for implementation of awgn channel noise. support variable snr. use LSFR to implement the pseudo random sequence. )
    2021-01-14 16:48:47下载
    积分:1
  • LPC1788_VGA_COLOR
    鼎lpc1788尚开发板的vga的显示,1024x768(lpc1788board,lcd to vga display,1024x768)
    2014-12-15 13:34:06下载
    积分:1
  • dianti
    实现电梯的相关控制系统,在开发板EGO1上实现,数码管显示相关的楼层和状态(dianti in verilog)
    2020-12-26 10:59:03下载
    积分:1
  • ov5640驱动代码
    ov5640的驱动代码,包括寄存器初始化,cmos图像的捕获,ddr内存的驱动,LCD驱动等。
    2022-04-30 23:32:42下载
    积分:1
  • LDPC_Encoder
    verilog 编写的ldpc编码,含有两个文件(LDPC written by Verilog)
    2021-03-08 19:19:28下载
    积分:1
  • zuoye2
    主要编写了一组二进制数据通过根升余弦滤波器后的波形,但并没有使用ISE内部的FIR滤波器内核,该程序相当于编写了一个根升余弦滤波器。(Mainly prepared a set of binary data through the root raised cosine filter waveform after, but did not use the ISE internal FIR filter kernel, the program is equivalent to the preparation of a root raised cosine filter.)
    2013-09-18 15:24:13下载
    积分:1
  • Flash-Memory-RAM
    周立功Fusion StartKit,fpga开发板的实验例程,Flash Memory初始化RAM实验(ZLG Fusion StartKit, fpga development board test routines Flash Memory Initialize RAM experiments)
    2013-03-07 20:36:48下载
    积分:1
  • HDB3-encoderauncoder
    HDB3编码器与解码器,以及RTL图,使用Verilog HDL实现(HDB3 encoder and decoder, and RTL diagram, use Verilog HDL to implement)
    2014-12-14 13:17:26下载
    积分:1
  • EDA1_MusicCalculator
    音乐计算器,可实现999以下加减法及与非运算功能,并能够播放两段音乐,可下载到FPGA板子上实现。(Music Calculator)
    2020-08-16 23:38:25下载
    积分:1
  • 696518资源总数
  • 106208会员总数
  • 21今日下载