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FIR
FIR滤波器的VHDL源代码及测试文件，已通过编译仿真，绝对正确。(FIR filter VHDL source code and test files, has passed the compiled simulation, absolutely correct.)
- 2021-04-15 11:08:54下载
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mux_16bit_sign
16位有符号和无符号乘法器FPGA源代码(16-bit signed and unsigned multiplier FPGA source code)
- 2016-05-09 21:48:03下载
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ISE
设计一4位比较器,画出门级电路图,用verilog语言完成设计。
(Design a four comparators, drawing out level circuit diagram, complete the design using verilog language. )
- 2015-12-11 21:16:12下载
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汽车自动化
使用VHDL汽车自动化技术VHDL代码1.镜旋转2.温度控制近期许多应用程序并通过VHDL它将会更容易
- 2022-07-06 12:18:03下载
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DSW
改变学习板上的2个电位器对应的2段模拟输入，实现模拟输入，学员观察数码管的数字变化情况,通过改D[4]的值，实现模拟输出.(Changing the learning board two potentiometers corresponding paragraph 2 analog inputs, analog inputs, digital tube digital trainees observe the changes, by changing D [4] value for analog output.)
- 2013-06-21 15:31:10下载
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report
report for a report for a class
- 2019-04-17 21:19:15下载
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VHDL38decoder
VHDL 语言实现 38译码器 文件中包括 程序 源代码 还有 testbench 测试程序(38 decoder VHDL language implementation, including program source code file, there are testbench test procedures)
- 2020-06-29 23:40:03下载
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VHDL FPGA 流水灯实验
应用背景流水灯实验，FPGA基础 设计流程 程序下载 流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载流水灯实验，FPGA基础 设计流程 程序下载关键技术VHDL 基本语法 设计思想 FPGA基础实例 VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例VHDL 基本语法 设计思想 FPGA基础实例
- 2022-03-05 21:23:07下载
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基于查找表的无波发生器
采用VHDL语言设计的基于LUT的正弦波发生器，已通过调试，并给出了pics仿真结果
- 2022-05-27 16:00:57下载
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MATLAB产生单脉冲信号的数据 exp_rom
说明： 通过MATLAB产生单脉冲信号的数据，存储下来作为verilog代码实现的DDS的数据源，用于验证DA数据的ddio的调试是否有问题。(The data of monopulse signal generated by MATLAB is stored as the data source of DDS implemented by Verilog code to verify whether the ddio debugging of DA data is problematic.)
- 2020-06-23 04:40:02下载
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