登录
首页 » Verilog » CPU 多周期

CPU 多周期

于 2022-03-25 发布 文件大小:899.16 kB
0 105
下载积分: 2 下载次数: 1

代码说明:

多周期CPU设计所有模块全部代码,ISE工具环境下,经验证成功实现

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • traffic 2
    说明:  实现主干道交通灯显示,以状态机程序实现,并用数码管进行红绿灯倒计时的显示,内置计数模块,交通灯控制模块,数码管显示模块,并对各模块用电路图的方式进行连接。对于学习VHDL语言有所帮助。(The main road traffic light display is realized by the state machine program, and the digital tube is used to display the traffic light countdown. The counting module, the traffic light control module and the digital tube display module are built in, and each module is connected by the circuit diagram. It is helpful for learning VHDL.)
    2020-06-25 19:55:12下载
    积分:1
  • LCD1602测试程序
    实现对LCD1602的Verilog HDL编程(the program for LCD1602 based on Verilog HDL)
    2020-06-23 21:00:01下载
    积分:1
  • verilog DDSAD854
    基于FPGA控制的AD9854DDS任意信号发生,实现了宽带线性调频信号等多种调制信号已经单频信号
    2023-05-10 14:10:04下载
    积分:1
  • adpcm verilog编码实现 详细的设计说明
     ADPCM编码的Verilog编码实现,代码有详细的注释,编译通过 内部包含每次设计以及改进文件更新记录,相应的信号说明描述,丰富的注释更好的帮助你掌握ADPCM音频信号编码
    2022-02-21 10:20:57下载
    积分:1
  • 基于fpga的dm900a模块
    DM9000A简介     主要特点     DM9000A实现以太网媒体介质访问层(MAC)和物理层(PHY)的功能,包括MAC数据帧的组装/拆分与收发、地址识别、CRC编码/校验、MLT-3编码器、接收噪声抑制、输出脉冲成形、超时重传、链路完整性测试、信号极性检测与纠正等。     工作原理 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
    2023-01-16 11:05:03下载
    积分:1
  • LIP4210CORE_SDIO
    SDIO Verilog Sourcw code
    2021-04-29 12:58:43下载
    积分:1
  • sram_test_OK
    主要是基于FPGA(EP2C8Q208I8)下的SRAM驱动,SRAM型号为IS61LV25616,程序语言为Verilog,开发环境为quartusII 7.0,为一工程,可直接下载到FPGA中,含电路图(Mainly based on FPGA (EP2C8Q208I8) driving under the SRAM, SRAM model IS61LV25616, programming language for Verilog, a development environment for quartusII 7.0, for a project, can be downloaded directly to the FPGA, including circuit diagrams)
    2014-12-24 22:08:36下载
    积分:1
  • i2c
    说明:  PIC32MX4系列单片机I2C总线模块示例代码 PIC32MX4系列单片机I2C总线模块示例代码PIC32MX4系列单片机I2C总线模块示例代码PIC32MX4系列单片机I2C总线模块示例代码(PIC32MX4 I2C PIC32MX4 I2C PIC32MX4 I2C PIC32MX4 I2C)
    2011-03-31 09:35:50下载
    积分:1
  • ad7606
    AD7606是8通道16位逐次逼近型ADC,有2种接口模式:串行接口模式和高速的并行接口模式,并行接口模式又分为8位和16位传送方式。在数据转换时,2个转换信号CONVSTA/B,用来控制每4个或每8个ADC同时采样。如果将2个CONVST引脚连接在一起,就可对8个ADC同时进行采样。
    2023-01-21 04:35:04下载
    积分:1
  • VerilogDHL
    VerilogHDL教程,很详细全面的Verilog教程,循序渐进,由浅入深,十分好的学习资料(VerilogHDL tutorial, very detailed and comprehensive Verilog tutorial, step by step, progressive approach, a very good learning materials)
    2011-07-13 14:19:53下载
    积分:1
  • 696518资源总数
  • 105563会员总数
  • 11今日下载