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FIR verilog

于 2022-08-10 发布 文件大小:15.17 MB
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代码说明:

应用背景 FIR(Finite Impulse Response,有限冲击响应)数字滤波器具有稳定性高、可以实现线性相位等优点,广泛被应用于信号检测与处理等领域[1,2]。由于FPGA(Field Programmable Gate Array,现场可编程门阵列)基于查找表的结构和全硬件并行执行的特性,如何用FPGA 来实现高速FIR 数字滤波器成了近年来数字信号处理领域研究的热点。目前,全球两大PLD 器件供应商都提供了加速FPGA 开发的IP(IntelligentProperty,知识产权)核[3]。本文在Altera 公司的FIR 数字滤波器IP 核的基础上,设计了基于分布式算法的FIR数字低通滤波器。 关键技术实现滤波器的功能,有限冲激响应(

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  • AD6 中进行FPGA设计与仿真
    说明:  AD6 中进行FPGA设计与仿真,很不错的资料哦(FPGA design and Simulation in AD6, very good data)
    2020-04-15 21:22:17下载
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  • wide_cbf
    宽带波束形成,设计FIR滤波器系数。带宽为500Hz--700Hz,采样率为3000Hz,对白噪声序列进行滤波,即得到有限带宽的宽带时域信号(Broadband beamforming design FIR filter coefficients. Bandwidth of 500Hz- 700Hz, sampling rate of 3000Hz, filtered white noise sequence, ie limited bandwidth broadband time domain signal)
    2013-03-19 09:40:45下载
    积分:1
  • zidong-shouhuoji
    用VERILOG实现自动售货机功能,运行正确,希望有帮助(Use VERILOG implementation vending machine function, correct operation, hope to have help)
    2014-01-05 20:42:49下载
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  • 基于FPGA的串口通信程序设计
    本代码是一个基于FPGA的串口通信程序设计,程序采用Verilog语言编写,工程中已经加入了仿真模型,并设置了仿真,如果你的电脑也安装了modelsim-altera,就可以直接点击RTL仿真,就能出仿真结果了。程序的主要功能实串口测试,当FPGA芯片收到上位机发送的数据时将数据再发回到上位机,在串口助手上进行显示。
    2022-03-22 10:58:18下载
    积分:1
  • pipelined_fft_64_128_256
    用verilog实现64点,128点,256点的fft(64 points, 128 points, and 256 points FFT are implemented with Verilog)
    2018-05-11 14:57:35下载
    积分:1
  • bt656
    生成bt656数据格式,针对视频adv7127芯片(Generate bt656 data format,)
    2017-08-30 18:12:58下载
    积分:1
  • 1.深入浅出玩转FPGA_吴厚航
    说明:  学习FPGA的优秀资料,从基础知识到开发设计再到仿真,很不错的FPGA学习资料(Excellent Teaching Materials for Learning FPGA)
    2019-05-11 14:48:07下载
    积分:1
  • vivado2019d1license
    说明:  vivado的license ,可以用在2019.1,2019.2,在win10 64bit上已检验过.(It can used in vivado2019.1,2019.2)
    2020-03-21 17:15:21下载
    积分:1
  • UART0407
    ise平台模拟UART,并与PC机实现收发(+1)(ISE platform simulation UART and transceiver.)
    2013-04-22 15:38:36下载
    积分:1
  • 交通灯控制系统
    基于veilog语言的交通灯控制系统,无左转灯,自制数字电子技术课程设计,仿真通过,由于是多个程序拼接外加本人水平有限,可能结构略有杂乱。
    2022-08-18 14:49:32下载
    积分:1
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