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verilog语言 秒表程序源代码及时序图

于 2022-05-20 发布 文件大小:390.85 kB
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代码说明:

用verilog语言详细编写的源代码及顶层文件,含有时序图分析。要求有Quartus2开发环境。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • dianzhen
    如果需要用verilog设计一项比较简单的功能,那么这个浅显易懂的程序能让你很快明白点阵的设计方法,尤其是对那些初学者(If you need to use a relatively simple verilog design features, then this easy to understand design of the program allows you to quickly understand the lattice method, especially for those who are beginners)
    2014-01-16 16:13:53下载
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  • tdc
    time to digital convertor
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    可编程的一般目的编程 I/O (GPIO) 外围设备。此组件是一个 AMBA 2.0 兼容先进的外设总线 (APB) 奴隶装置。DW_apb_gpio 块: ■ APB 接口或从 APB 桥的主要接口,下列功能团体■ 外部数据接口或从 I/O 垫■ 辅助硬件数据接口给或来自辅助数据接收器或源■ 中断接口或从中断控制器
    2022-04-25 16:45:53下载
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  • Icache设计
    一款16位DSP芯片的Icache的设计,本设计仅针对相应方案,对Icache的失误率的控制,通过仿真后已能达到基本要求,。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。
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    字长可以简单调整,即可实现任意字长UART通讯(The word length can be simply adjusted to achieve any word length UART communication.)
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    Actel 8051 Verilog core
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    按键可调占空比的PWM波产生程序。语言:VHDL(Button adjustable duty cycle of the PWM wave generator. Language: VHDL)
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  • nco11000
    实现输入一正弦波和噪声的叠加,介绍详细欢迎下载(The input of a superposition of sine wave and noise introduced in detail)
    2010-05-16 14:19:53下载
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  • agc_gen
    AGC(自动增益放大) Verilog代码 设计可以参考(AGC (automatic gain control) can refer to the Verilog code design )
    2015-04-14 01:16:13下载
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