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verilog语言 秒表程序源代码及时序图

于 2022-05-20 发布 文件大小:390.85 kB
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代码说明:

用verilog语言详细编写的源代码及顶层文件,含有时序图分析。要求有Quartus2开发环境。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • tiny-dnn-1.0.0a2
    在zedboard上运行的神经网络架构,方便移植。(Run lenet-5 on zedboard)
    2020-06-23 19:00:02下载
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  • sdram_cmd命令集
    sdram_cmd.v是控制sdram的命令集合。网上资料,是控制sdram的命令集合。网上资料。控制sdram的命令集合。网上资料控制sdram的命令集合。网上资料。
    2022-05-10 21:41:40下载
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  • EAACK secure system
    很好,我在做简化编码语言IIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIIII
    2022-08-06 08:04:27下载
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  • 编码器-使用if else 语句
    编码器 编码器是设备、 电路、 传感器、 软件程序、 算法或人 thatconverts 信息从一个格式或代码到另一个,为标准化、 速度、 保密、 安全、 或通过收缩大小节省空间的目的。 简单的编码器 一种简单的编码器电路可以接收单个活动输入 2 n 输入的行上生成二进制代码 n 并行输出线。 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报 打分 发表评论 暂无评论
    2023-06-02 12:00:04下载
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  • SRAM
    SRAM读写测试实例,每秒钟进行一次单字节的SRAM 读和写操作,用chipscope查看时序波形。(SRAM read and write test instances, each time a single byte SRAM Read and write operations, use chipscope to see the timing waveform.)
    2017-09-06 11:43:06下载
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  • Ping_pong_Sparten3e-master
    说明:  FPGA实现乒乓球游戏 代码及仿真 VGA实现(FPGA realizes table tennis game code and simulation VGA implementation)
    2019-05-06 20:22:13下载
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  • verilog等精度测量源码(附带SPI单工通信模块)
    应用背景 使用verilog依靠等精度测量原理设计数字频率计,测量数据输出为64位,使用单片机进行简单的解码和显示,就能得到被测信号的频率,门控信号持续时间,也就是采样时间越长,fpga使用的晶振越准,越高速,测出来的效果越好,测量时间一定要高于被测信号的周期,这个只是取决于单片机对门控信号的控制。 等精度测量的最上层文件是dengjingduceliang.v 等精度测量的模块是DJDCL.v spi通信模块是SPI_8BYTE 使用的方法是,三个文件放在一起,上层文件和fpga的io配置好,什么输入什么输出,然后把DJDCL.v的input和标准时钟,我的是50M,还有被测信号接在一起,会输出一个64位的数据,前32位为标准时钟计时,后32位为被测信号计时,传给mcu简单计算一下就有了被测信号的频率关键技术  1.1    测频方法 这种方法即已知时基信号(频率或周期确定)做门控信号,T为已知量,然后在门控信号有效的时间段内进行输入脉冲的计数,原理图如下图所示:   请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报
    2022-01-26 06:18:40下载
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  • VHDL--VGA
    此VHDL语言程序可以控制液晶屏幕任意动画播放(The VHDL language program can control the LCD screen any animation)
    2015-03-27 18:44:28下载
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  • 基于FPGA控制的DDS波形发生器
    基于FPGA控制的DDS波形发生器,可在Cyclone IV系列板子上使用,已经过仿真验证(Based FPGA control DDS waveform generator in Cyclone IV series board on use, has been simulation)
    2017-03-17 11:08:39下载
    积分:1
  • 静态时序分析
    说明:  fpga 静态时序分析 是电子工程中,对数字电路的时序进行计算、预计的工作流程,该流程不需要通过输入激励的方式进行仿真。(Static time series analysis is a work flow which can calculate and predict the time series of digital circuits in electronic engineering.)
    2020-06-16 11:10:56下载
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