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ddr2控制器 Verilog编写

于 2022-06-29 发布文件大小:16.18 MB

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代码说明：

应用背景Verilog语言编写的ddr2控制器，主要通过控制ddr2的用户侧界面控制ddr2的读写，本程序主要完成一次简单的写地址，写数据到ddr2里，并且再写地址，读数据回来，以此校验ddr2的读写。关键技术通过在xilinx ise工具里进行综合仿真，并且在xilinx v5 110t板子上成功实现读写。通过控制用户侧界面的ap_af_addr,app_wdf_addr,等app信号写进ddr2控制器里，在读回read_data_fifo信号

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