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游戏所有侵略者都都属于我们的 Verilog

于 2022-07-18 发布 文件大小:3.42 MB
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代码说明:

接下来是模仿经典的嵌入式系统的实现与设计街机游戏太空入侵者。这个项目利用 Altera 硬件和软件功能DE2 板。实施涉及 C 和 vhdl 语言的组合。我们使用的是 PS/2 键盘,VGA显示器和外围设备作为沃尔夫森 WM8371 音频编解码器。所有侵略者都属于我们! 一个二维的固定射击游戏,玩家控制通过横向穿过屏幕的底部,并射击,降序外星人的家船。目的是打败五排在作为屏幕上来回横向移动的十二个外国人他们迈向屏幕的底部。球员击败了外星人,并通过挣点,用激光导弹射击它。打败外星人带来另一波更难,一个循环,可以继续下去。外星人企图破坏家船由它射击,虽然他们接近底部屏幕。如果他们到达底部,外星人入侵成功,游戏就结束了。家船部分受可毁于外星人的四个固定防御路障和首页-船。这场比赛我们翻译分为 3 个阶段: 游戏开始阶段: 这一阶段包含询问球员他/她是否准备好了"拯救地球"的介绍屏幕。游戏的玩阶段: 这是游戏的主要阶段。玩家扮演的这场比赛是由射击在外星人的波浪,因此按顺序结算水平。每个玩家开始 3 的生活。他 / 她能不能输掉比赛以两种方式: 如果他/她获取由外来导弹射击 3 次,或如果外星人波收益这样远了,他们到达了街垒水平 (这表明成功的外星人入侵 !)。游戏结束阶段: 上输掉了比赛,游戏状态转到游戏结束屏幕。的用户可以通过按输入键重新启动游戏,并恢复拯救地球

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

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  • my_lms
    自适应滤波,对输入信号进行选择性的加权处理,使输出达到最优化,并且能够跟踪和适应系统和环境的动态变化(Least mean square,of the input signal processing, selective weighted output, and optimize can track and adapt to the dynamic changes of the system and environment)
    2010-10-14 15:30:00下载
    积分:1
  • CPU
    十一和通过vivado实现多周期cpu,各种作业再里面包含了(Realizing multi period CPU)
    2020-12-29 10:19:00下载
    积分:1
  • uart
    Verilog UART is written in this file
    2013-04-16 12:34:05下载
    积分:1
  • pld_Tetris
    基于FPGA cyclone III EP3C16F484C6的俄罗斯方块游戏。实现双人进行,屏幕倒置,分数显示,vga接口,键盘接口等功能(Tetris game based on FPGA cyclone III EP3C16F484C6 with functions including double players, screen upside down, score, vga and keyboard interface.)
    2020-11-06 12:39:49下载
    积分:1
  • sanjose_hdlcon
    FFT implementation using C program
    2014-02-11 21:01:40下载
    积分:1
  • fsk
    基于FPGA的fsk调制程序,包括载波的生成,nco的设置(FPGA-based fsk modulation procedures, including carrier generation, nco settings)
    2016-05-12 21:00:56下载
    积分:1
  • IEEE Standard for Verilog 2005
    说明:  verilog 2005 IEEE 标准手册(IEEE Standard for Verilog 2005 Hardware Description Language)
    2020-02-10 22:07:05下载
    积分:1
  • 简单的CPU(源代码和合成脚本)
    应用背景此文件包含所有的源代码和脚本,以Altera公司的简单CPU的合成。500MHz时钟设计运行。 ;关键技术使用CLA提高速度的设计。这只是一个简单的CPU,它的结构很简单,它没有任何管道或类似的东西。
    2022-04-30 14:14:37下载
    积分:1
  • TDMsystem
    实现多路可变时分复用,包括复接器,解复接,比特同步,帧同步,分频器(Implement multi-channel variable time division multiplexing, including multiplexer, demultiplexing, bit synchronization, frame synchronization, frequency divider)
    2018-09-16 23:29:09下载
    积分:1
  • ba_ker
    巴克码装到信息内同时将巴克码识别出来,实现帧同步的VHDL设计(Barker code loaded to the information identified while Barker code, VHDL design to achieve frame synchronization)
    2014-05-18 17:37:39下载
    积分:1
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