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FFT processor design and applied research, suitable for signal processing fpga t...

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FFT处理器设计及其应用研究，适合做fpga信号处理的技术人员参考-FFT processor design and applied research, suitable for signal processing fpga technology reference

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128点基8 FFT
使用Verilog语言对128点基8FFT的实现(Implementation of 128-point basis 8FFT)

2018-11-29 14:39:32下载

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MUX
Multipleksor 3 to 1 - 3x1bit in, 1x1bit out

2013-09-18 16:21:25下载

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FPGAshixu
FPGA经验总结：时序是设计出来的我们在做详细设计的时候，对于一些信号的时序肯定会做一些调整的，但是这种时序的调整最多只能波及到本一级模块，而不能影响到整个设计。(FPGA Experience: Timing is designed to do the detailed design of our time, for some signal timing will certainly make some adjustments, but adjust this timing can only spread to up to this level of the module, but not affect the whole design.)

2015-03-13 10:27:51下载

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airthmatic & logic unit
airthmatic & logic unit

2023-02-23 08:10:03下载

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lpddr2
LPDDR2 SDRAM memories compliant to JEDEC JESD209-2.

2015-05-11 20:57:21下载

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VHDL语言串口接收数据
VHDL语言，实现穿行数据接收的功能，将异步串口的数据转换为八位数据存储。

2022-03-24 16:10:35下载

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CDCM6208_SPI
说明：完成对cdcm6208的时钟芯片的配置，输出高频时钟(cdcm6208 cofigure using SPI interface)

2021-02-06 18:29:56下载

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math_real
in this code very useful for designing real number concept

2013-11-19 19:54:40下载

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VHDL语言写的波形发生器和sine波形发生器
VHDL语言写的波形发生器和sine波形发生器,一共两个文件，通信开发平台专用。这是一个典型的正玄波发生器程序和一个任意波形发生器程序，大家可以参考学习，对于vhdl入门还是很有帮助的-This is a typical wave generator Shogen procedures and an arbitrary waveform generator procedures, Members can take a learning portal for VHDL or helpful

2022-05-29 18:31:54下载

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VHDLFIFO
用Verilog 写一个8x16 的FIFO，完成先入先出的功能，并且在FIFO读空时输出EMPTY 有效信号，读指针RP 不再移动；FIFO 写满时输出FULL 有效信号，并且即使WR 有效也不再向存储单元中写入数据(写指针WP 不再移动)。 (NO)

2020-09-20 20:17:51下载

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