登录
首页 » Verilog » 四则计算器

四则计算器

于 2022-08-10 发布 文件大小:5.81 MB
0 102
下载积分: 2 下载次数: 1

代码说明:

基于basys3制作的简易四则运算计算器,能够计算加减乘除,将每部分代码封装成ip和在vivado 2015.4上进行开发,结果正确,

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • nfc
    近场通信的verilog描述,包含向量名定义,顶层设计等等的精确描述(Verilog description of near field communication, including the vector name is defined, an accurate description of the top-level design, etc.)
    2015-08-11 15:27:41下载
    积分:1
  • 四位密码锁
    4位密码锁,可设置密码,三次密码错误后,锁死,密码错误报警,密码错误红灯亮,密码正确绿灯亮,基于FPGA实现,Cyclone II  EP2C35F672C6 仅供参考
    2022-01-26 07:59:07下载
    积分:1
  • Verilog RS232代码
    Verilog RS232代码, 分为三个模块,时钟产生模块,发送数据模块,接收数据模块。 整个工程的功能是,你从串口上位机发送什么数据,串口就将该数据重新发送回上位机
    2023-02-16 19:05:04下载
    积分:1
  • sdram verilog
    sdram FPGA verilog设计  有源码有设计文档
    2023-04-21 03:40:04下载
    积分:1
  • shizhong
    VHDL写时钟,分频模块什么,实现计时。定点报时,定点闹钟,显示年月日。(verilog HDL)
    2014-01-09 18:29:40下载
    积分:1
  • 32_lvds_test
    Xilinx 公司Spartan-6系列FPGA实现LVDS,带Modelsim仿真文件,已综合。(Xilinx Spartan-6 Series FPGA implements LVDS with Modelsim simulation file, which has been synthesized.)
    2020-11-30 20:59:27下载
    积分:1
  • 基于ep4ce22的verilog串口程序
    基于ep4ce22的verilog串口程序,可发送24bit,希望能给大家提供帮助。
    2022-05-30 03:01:25下载
    积分:1
  • uart-gen.rar
    uart-gen.rar,是关于异步通信的1.在内部环路测试没有问题,逻辑应该基本是没有问题的。但是如果转成外部通讯的话,看一下数据输入和输出时候的同步性。 2.用逻辑分析仪或者chipscope抓一下错误的数据,看能不能找到错误发生的规律。 3.请关注一下波特率的设置:在内部测试的时候是不是和外面接收时候一样,注意到波特率和频率的关系。 4.将ucf里面io试着换一下,查一下io的驱动能力,还有io最好不要悬空,接弱上拉看看。
    2022-01-25 21:16:56下载
    积分:1
  • altera实现的UDP协议(Verilog实现)
    Verilog实现的udp协议,比网络上的资源更加丰富,想要了解altera tse相关源码,就大胆下载吧,给你想要的一切。
    2022-04-27 08:25:46下载
    积分:1
  • 适合CPU初学者
    本文使用三级流水线的方式实现CPU。该CPU工实现加、减、移位、跳转等十多条常用指令。并在FPGA开发板中成功实现流水灯。频率能达到200M.该CPU实现的方式简单,适合初学者学习。里面有详细代码和指令结构。
    2022-04-12 07:12:27下载
    积分:1
  • 696518资源总数
  • 105559会员总数
  • 1今日下载