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基于Verilog的32位CRC校验

于 2022-08-11 发布 文件大小:133.42 kB
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代码说明:

基于Verilog语言的8位数据32位校验码,本模块以一次读取256个数据为例,循环产生32位校验码,对数据进行校验,反校验时,读取校验256位数据后在对产生的32位校验码取反校验,会产生一个32位crc校验的固定数据

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  • verilog_DATA_displays
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