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OFDM_QPSK
给予QPSK调制的OFDM例程，简单明了的表述了OFDM的通信原理(Given OFDM QPSK modulation routine, simple expressions of OFDM communication theory)
- 2013-08-15 14:26:43下载
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核心发电机与设计实现
本实验室练习的目的是为了了解有关生成内核的项目和实施上斯巴达 2 设计的概念或斯巴达 3 板.Xilinx 是可编程逻辑市场中的最大供应商。其 Fpga 在世界使用最广泛。目前其 Fpga 主要分为 3 家庭 ︰ 容量 7(most powerful)，Kintex-7(mid-range) & Artix-7(least powerful)，7 代表当前一代。起初，有只有两个，高功率 （容量系列） 和高容量 （斯巴达系列）。斯巴达 3 已经做过的最广泛使用 FPGA 之一，目前很多教育机构使用它向学生传授数字逻辑设计。
- 2022-10-16 04:15:03下载
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src
说明： 假设每个从设备中有可访问APB寄存器16个，位宽均为32比特，16个寄存器的访问地址计算方式为 基址 + 寄存器编号左移２位（byte 偏移）(Assuming that there are 16 accessible APB registers in each slave device, the bit width is 32 bits, and the access address of 16 registers is calculated by base address + register number left shift 2 bits (byte offset).)
- 2020-12-15 13:49:14下载
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cordic算法的Verilog实现
CORDIC 算法可以通过不同的实现形式解决乘、除、平方根和一些三角函数运算问题。以往这些三角函数的计算问题是用硬件是
不易实现的，而CORDIC算法能够很好的解决这种问题。通过算法本身，可以将复杂的算法转换成一些很容易在硬件中实现的算法。
例如加法、移位等。该算法的基本思想是通过一系列的角度的不断偏转迭代，逐渐逼近所需的旋转角度，从而完成矢量旋转。
- 2022-03-21 13:52:43下载
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CPU
十一和通过vivado实现多周期cpu，各种作业再里面包含了(Realizing multi period CPU)
- 2020-12-29 10:19:00下载
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fsm
有限状态机工作原理、设计方法、步骤等精要说明(Finite state machine working principle, design method, such as Essentials of steps to explain)
- 2010-02-13 17:46:25下载
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Verilog数字系统设计教程(第二版) 夏宇闻
说明： Verilog数字系统设计教程(第二版) 夏宇闻(Verilog Digital System Design Course (2nd Edition) Xia Yuwen)
- 2020-06-20 18:40:02下载
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LMS
verilog实现的LMS的算法，另外有tb文件可以测试已测试代码正确……(verilog implementation of LMS algorithm, another tb files can test the code has been tested properly ......)
- 2021-03-12 15:29:25下载
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SPI
design and implement a digital system on the Altera NIOS board which will read an analogue input using MicroChip’s SPI MCP3202 12-Bit A/D converter. The 8 most significant bits of the converted data will be displayed on two seven segments of the NIOS development board. The sampling frequency is 20kHZ. Use a potentiometer.(design and implement a digital system on the Altera NIOS board which will read an analogue input using MicroChip' s SPI MCP3202 12-Bit A/D converter. The 8 most significant bits of the converted data will be displayed on two seven segments of the NIOS development board . The sampling frequency is 20kHZ. Use a potentiometer.)
- 2010-08-17 19:16:12下载
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cla - Copy
说明： ADDER USING VERILOG ADDER WITH VERILOG VERILOG ADDER
- 2019-03-19 01:35:37下载
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