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关于 NIOII IO 与沟通

于 2022-09-20 发布文件大小:19.84 MB

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代码说明：

我有一个完整的项目 CPU Nios II 与 IO 设备之间如何进行通信：我用 32 开关： [31:0] 作为输入设备进行通信与加利福尼亚 Nios2.And 后我使用 31 红色的 led 指示灯显示输入从开关的值。我希望我可以帮助您了解有关与 CPU Nios2 IO 设备之间进行通信，这是一个例子，您可以开发遵循你的目的！

下载说明：请别用迅雷下载，失败请重下，重下不扣分！

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ZedBoardyuanlitu
zedboard原理图详细，PCB板焊接方便，每个接口表明清楚。(Zedboard schematic in detail, PCB board welding is convenient, each interface that clearly.)

2017-01-03 20:07:20下载

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6b9074ce1a0287439b03d7463ac22bb3
测温，数码管显示，基于FPGA 的verilog程序，基于DS18B20(Temperature measurement)

2018-03-10 20:40:59下载

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基于FPGA和matlab的IIR滤波器设计
基于FPGA和matlab设计的IIR滤波器，利用matlab的simulink工具进行设计，包含了源码和相关文档说明，希望能够对大家有所帮助

2022-04-02 06:35:36下载

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v-watch
基于fpga的数字电压表的设计，包括ad转换，bcd码转换，分频，3选1模块，小数点生成模块，显示模块组成。(Based on the FPGA digital voltage meter design, including AD conversion, BCD code conversion, frequency,3 choose1module, a decimal point generating module, display module. )

2012-05-10 01:29:23下载

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chaoshengbo_diatance_hc_sr_04
说明：实现Verilog编程，实现超声波测距模块实现测距功能，并将测得的距离显示在数码管上(Verilog programming is realized, ultrasonic ranging module is realized, and the measured distance is displayed on the digital tube)

2020-06-17 16:40:02下载

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n_bit_paralleLoadShiftRegJK
n_bit_paralleLoadShiftRegJK

2017-11-17 17:27:49下载

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SDRAM
verilog编写的SDRAM实验，有串口调试助手和相关资料！！！！！！！！！！！！！！！！！！！！！(Verilog prepared by the SDRAM experiment, a serial debugging assistant and related information!!!!!!!!!!!!!!!!!!!!!)

2014-09-13 11:24:46下载

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数据检测器
说明：设计一个串行数据检测器，当连续输入三个或更多1时输出1，否则输出0(Design a detector for serial data It outputs 1 when three or more 1 input continuously and outputs 0 otherwise)

2020-01-02 15:24:34下载

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fpga_debounce_filter
fpga debounce filter code in vhdl

2009-10-02 18:48:22下载

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RS_255_223_ENCODER
rs255编码解码器，verilog描述，FPGA实现(RS255 223 ENCODER)

2015-03-30 09:52:09下载

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