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将Rs232转化为Rs485

于 2022-10-14 发布文件大小:640.73 kB

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代码说明：

前面上传了一个RS485通信的Verilog代码，这一个是另外一种方式实现RS485通信的Verilog代码。通过多种代码对比，有利于设计需要的电路。此外由于软件的不同，需要利用源码，在自己的软件上新建工程文件，实现运行，仿真

下载说明：请别用迅雷下载，失败请重下，重下不扣分！

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alu2
verilog alu 8bit for engineers

2011-05-26 11:32:21下载

积分：1
chengxu_jieshou
nrf24l01发送代码，verilog实现NRF24L01通信(NRF24L01 send code, Verilog to achieve NRF24L01 communication)

2017-08-09 19:04:16下载

积分：1
ZF-SIC_TPA
迫零-串行干扰删除检测的程序，包括16QAM和QPSK(Zero forcing- Interference Cancellation detection procedures, including 16QAM and QPSK)

2020-10-23 15:27:22下载

积分：1
VENDTEST
此为实现第14.7.9章所需的激励文件该代码为门级RTL描述。(Stimulus file to verify Section 14.7.9 the functionality of gate vs. RTL description.)

2011-08-11 15:07:16下载

积分：1
UART 完整
复制去Google翻译翻译结果

2022-03-12 20:17:34下载

积分：1
三维小波变换
三维离散小波变换的代码

2022-03-06 08:50:16下载

积分：1
homework32
说明：这是32位移位寄存器，是用verilog编写的，能够实现从1到31位的左或右的移位(This is a 32-bit shift register, is prepared verilog, can be realized from the 1-31 shift left or right)

2009-07-27 15:54:00下载

积分：1
显示FPGA板上的几个LED灯
这段代码件实事吊炸天了，我重来都没有看过更好的了。学习verilog就必须要知道学会汇石油这段嗲吗，因为他真的很棒！

2022-03-01 04:21:35下载

积分：1
AMBA APB协议
APB是专为低带宽控制访问，就系统的外围设备例如寄存器接口。这种总线具有一个地址和数据相类似的AHB，但大大减少，低复杂度的信号列表中（例如，没有脉冲串）。它支持32位和66 MHz的信号。 APB主机和从机

2022-04-28 05:04:55下载

积分：1
5-15
用verilog语言实现基于DDS技术的余弦信号发生器，其输出位宽为16比特(Verilog language cosine signal generator based on DDS technology, the output bit width is 16 bits)

2013-04-18 22:58:05下载

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