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myfir
verilog编写的16阶升余弦滤波器 采用直接型结构实现 对方波进行滤波 输出波形 含testbench文件(order raised cosine filter verilog written 16 direct-type structure to achieve the other wave filtering the output waveform containing testbench file)
- 2020-10-05 16:47:44下载
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xapp1014-xilinx-sdi
用fpga实现SDI，每一步都很清楚 搞视频的可以参考(Fpga realization of SDI, each step are clearly engaged in the video can refer to)
- 2020-11-10 19:19:46下载
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dotdisplay
16*16点阵横向移动显示！采用QUARTUS II 9.0编译通过！(16* 16 dot matrix display lateral movement! Compiled by using QUARTUS II 9.0!)
- 2011-11-04 22:14:49下载
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verlog通过FPGA实现数字钟
verlog通过FPGA实现数字钟，包含时间计数，秒表和闹钟等功能
- 2022-03-14 07:30:03下载
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cursor
对输入视频图像处理，在图像中叠加十字光标，光标颜色可以自动反色(The input video image processing, the image superimposed cross cursor, the cursor can be automatically color color)
- 2017-10-20 15:15:23下载
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OFDM_TX_CR802.11-master
OFDM_TX_CR802.11-master 802.11协议 ofdm开发(OFDM_TX_CR802.11-master)
- 2018-11-15 17:03:03下载
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FIR_poroje
this project is about FIR FIlter By VHdl codes in the ISE.
- 2013-09-29 19:25:16下载
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elevator-control
三层电梯的详细电路
Foundation版 包括强行开关门打断(Elevator control
Foundation project)
- 2011-09-26 17:57:56下载
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DDSa
程序是完整的一个数字下变频器的一个Verilog程序，经测试可以使用，欢迎下载(Program is a complete Verilog program a digital down converter, tested can be used, please download)
- 2016-05-23 22:11:25下载
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all clock
说明： 数字钟通过verilog实现，并且支持Modelsim仿真(The digital clock is implemented by Verilog and supports Modelsim simulation)
- 2020-06-18 05:00:01下载
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