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Tun2CNk2
FPGA实现DSP的Verilog 示例(FPGA realization of DSP-Verilog Example)
- 2008-05-05 17:08:19下载
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基于fpga的vga输出灰阶测试图片
使用软件：quartus 2 13.0基于DE2_115实验板vga输出灰阶测试图片
- 2022-09-25 04:25:03下载
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QPSK_demod
说明： QPSK的解调程序，采用Verilog编写而成(QPSK demodulation program, written by Verilog)
- 2020-02-29 19:51:38下载
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test2
说明： 试用Verilog HDL语言，设计十进制计数器，将计数过程用一个数码管进行显示（0～9）。要求首先使用Modelsim软件进行功能仿真，然后使用Quartus软件综合，并下载到开发板进行电路功能测试。(Using Verilog HDL language, a decimal counter is designed. The counting process is displayed by a digital tube (0 ~ 9). It is required to first use Modelsim software for functional simulation, then use quartus software for synthesis, and download to the development board for circuit functional test.)
- 2020-05-17 11:07:28下载
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DDR2_16bit
说明： ddr2原理图设计，原厂电路图设计，很好很强大 16bit(ddr2 schematic design, the original schematic design, a very powerful 16bit)
- 2011-02-24 11:07:35下载
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FIR100
说明： 基于FIR设计的100阶数字滤波器，选择的矩形窗(100 - order digital filter based on FIR)
- 2020-03-06 16:20:41下载
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spi_controller
SPI控制器，基于VERILOG描述，分模块设计，共6个模块，时钟产生模块，移位模块，主模块，从模块，定义模块，顶层模块。(SPI controller, based on the VERILOG description, sub-module design, a total of six modules, clock generation module, shift module, main module, from the modules, custom module, top module.)
- 2021-05-13 13:30:02下载
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第八部分 EEPROM读写例程
在AX309开发板上有一个IIC接口的EEPROM芯片24LC04，容量大小为4Kbit，用户可以用来存放一些硬件设置数据或者用户信息。因为EEPROM为掉电后数据不丢失的存储芯片，另外用户也可以通过IIC总线对它进行多次编程。想要读写EEPROM，我们首先要理解IIC总线读写的时序。
- 2023-05-27 18:10:04下载
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fir 滤波，分块缩放
图像处理，支持14阶的fir滤波，x方向分块缩小
- 2022-06-16 22:27:19下载
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hdl-master
ADI ad9361 vivado 下源代码(ADI ad9361 vivado source code)
- 2015-08-30 21:39:28下载
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