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1. FPGA时序约束和timequest timing analyzer

  约束所有时钟(包括你的设计中特有的时钟)对准确的时序分析结果而言是必不可少的。Quartus II TimeQuest Timing Analyzer为各种各样的时钟配置和典型时钟提供许多SDC命令。(Constraining all clocks, including the clocks unique to your design, is essential for accurate timing analysis results. The Quartus II TimeQuest Timing Analyzer provides many SDC commands for a variety of clock configurations and typical clocks.)

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2018-06-06发布

2. FPGA_homewrk2

  设计一个能求出一个32bit字中两个相邻0之间最大间隙的电路。完成HDL设计及testbench描述,给出综合后的时序仿真结果。文档报告(Design a circuit that can find the maximum gap between two adjacent 0 in a 32bit word. The HDL design and testbench description are completed, and the result of comprehensive simulation is given. Document report)

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2018-05-07发布

3. t3.slx

  开关磁阻电机转矩分配函数的源程序和一部分建模(Source code and part modeling of torque distribution function of switched reluctance motor.)

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2018-04-16发布

4. 基于ATmega128和CH374的USB接口

  基于ATmega128和CH374的USB接口设计(Design of USB interface based on ATmega128 and CH374)

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2018-04-12发布

5. 2-phase交错PFC 02

  该文档讲述了一种交错并联型PFC电路的设计,设计大功率PFC电路时可以参考一下(This document describes the design of a interleaved parallel PFC circuit, and can be referenced when designing a high-power PFC circuit.)

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2018-04-11发布

6. Simplorer--thesis

  基于 Simplorer /MATLAB 的多电飞机环控系统研究 基于Simplorer_Maxw_省略_l的多电飞机机电驱动系统仿真研究 基于SIMPLORER的电源电路仿真_李傲梅 装甲车辆电源系统Simulink与Simplorer联合仿真_康洪铭(Study on Environmental Control System of More Electric Aircraft Based on Simplorer /MATLAB)

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2018-04-10发布

7. BLDCM

  无刷直流电机结构图,用visio画的,可以粘贴到论文中(Brushless DC motor structure diagram)

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2018-03-20发布

8. 基于LabVIEW的振动时效数据采集

  一种振动时效数据采集系统的软、硬件设计方案,采用labview作为开发平台。振动时效能够很好地消除铸、锻、焊件的残余应力,是一种新型的时效技术。(The software and hardware design of a vibration aging data acquisition system is designed by using LabVIEW as the development platform. The vibration aging can eliminate the residual stress of the cast, forging and welding parts well, and it is a new kind of aging technology.)

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2018-01-24发布

9. 多永磁同步电机同步控制策略的研究_刘坤

  多永磁同步电机同步策略研究,包括模糊控制和自抗扰控制。(Research of permanent magnet synchronous motor synchronization strategy.)

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2017-12-19发布

11. LOAD

  文件为基于蒙特卡洛模型的电动车充电负荷计算,包括电动公交车,电动私家车和电动出租车等(The calculations are based on Monte Carlo models for electric vehicle charging, including electric buses, electric private cars, and electric taxis)

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2017-10-09发布

13. ML5238 Ver1.0

  日本罗姆ML5238设计文档及DEMO版资料!(Japanese Rohm ML5238 design documents and DEMO edition information!)

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2017-07-25发布

14. 动基座初始对准及相关问题研究

  该论文对动基座初始对准问题进行了研究,包括大失角下初始对准;内杆臂效应分析与补偿 ;整周期采样对姿态解算精度的影响;经典的圆锥误差运动补偿等方面,具有较强 的 研究价值,值得推荐!(This paper studied the dynamic initial alignment problem, including the loss of large angle alignment; analysis and compensation of lever arm effect sampling; influence on attitude calculation accuracy; coning error motion compensation and other aspects of the classic, has strong research value, worthy of recommendation!)

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2017-07-23发布

15. doc_7

  comparativestudy between two control strategies of electrical machines: Direct Torque Control (DTC-SVM), andPredictive Direct Torque Control (MPDTC).

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2017-05-20发布

16. SPD-MEF

  A Structural Patch Decomposition Approach

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2017-05-16发布

17. Constellation-communication

  通信中星座图的完整详细解释,里边包含具体的星座图由来以及具体的实现程序。(Constellation communication full explanation in detail, which include specific constellation diagram of origin as well as the concrete implementation process.)

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2017-05-05发布

18. Low-Wind-Speed-Turbine

  在低风速情况下,风力发电机组的先进变桨距控制策略的程序(Low Wind Speed Turbine Project Conceptual Design Study: Advanced Independent Pitch Control)

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2017-04-18发布

19. JTIDS-system-data-model

  该文简要说明了JTIDS 的工作方式 , 从JTIDS 系统的数据模型入手 , 完成了包括RS编码 、 交织编码 、 软扩频 、 MSK 调制 、 跳频 、 跳时在内的整个JTIDS 系统仿真(This paper briefly describes the working mode of JTIDS, starting the JTIDS system data model, including the completion of the entire JTIDS system simulation RS encoding, interleaving encoding, soft spread spectrum, MSK modulation, frequency hopping, hopping, )

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2017-04-14发布

20. Farrow-filter-error

  用 Farrow 结构滤波器对并行采样信号进行时间误差校正, 通过 DSPBuilder 软件将设计的滤波器模型转化为硬 件语言, 利于 FPGA 实现(The Farrow filter is used to correct the time error of the parallel sampling signal, and the designed filter model is converted to hard by DSPBuilder software Language, conducive to the realization of FPGA )

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2017-04-14发布