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子带编码,在Verilog SPIHT算法

于 2022-01-25 发布 文件大小:20.85 kB
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  • BPSK
    说明:  先用Matlab理论仿真,再用Verilog语言在ISE环境下编写程序,可通过手机发送指令来控制上下变频器的参数。(Firstly, we use the theory of MATLAB to simulate, and then use Verilog language to write programs in ISE environment. The parameters of up-down converter can be controlled by sending instructions from mobile phone.)
    2020-06-19 22:40:02下载
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  • FIR
    说明:  一个1MHz的FIR低通滤波器。 ① 时钟信号频率16MHz; ② 输入信号位宽8bits,符号速率16MHz; ③ 要求在Matlab软件中进行FIR滤波器浮点和定点仿真,并确定FIR滤波器抽头系数; ④ 写出测试仿真程序。(A 1MHz FIR low pass filter. (1) The clock signal frequency is 16MHz; (2) The input signal has a bit width of 8 bits and a symbol rate of 16 MHz; (3) Floating-point and fixed-point simulation of FIR filter is required in Matlab software, and tap coefficients of FIR filter are determined. (4) Write the test simulation program.)
    2019-06-19 21:47:13下载
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  • 频率除以 3 计数器
    频率除以 3 的计数器。用于筛选器图形。所需的频率获取除以 3。
    2022-03-26 18:51:30下载
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  • verilog_lab_solution
    Verilog 实验代码。。。经典的,里面都是完整的项目文件。 ISE环境。(Verilog test code. . . Classic, which is a complete project file. ISE environment.)
    2011-12-01 23:44:40下载
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  • 乔尔迪奇算法
    CORDIC (协调旋转数字计算机) 是一种算法计算先验 功能类似正弦和余弦反正切值。该方法还可以进行轻松地扩展来计算广场 根,以及双曲函数。 该算法的工作原理是降低为其成微轮换数目计算 反正切值预计算并加载在一个表中。此方法可以减少到计算 加法、 减法,进行比较,并转移。由 Fpga 轻松地执行所有功能。 高度可配置的乔尔迪奇核心实现第 1 象限坐标旋转数字计算机 要计算超越函数算法。核心通过 " 在源中定义,可以实现 RTL 三个体系结构之一: 组合 迭代 流水线 组合实现解决方程在一个时钟周期为许多级别的代价 逻辑。迭代的方法将问题分解成迭代次数。这种方法
    2022-04-26 22:24:21下载
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  • HOWTO_-Get-Configuration-and-Location-Information
    this document used for how to get config and location information of PCI card
    2012-07-21 12:26:16下载
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  • VGA_FPGA
    基于FPGA的VGA控制器,可在屏幕显示彩色条纹(A vga controller based on FPGA)
    2014-08-15 21:35:07下载
    积分:1
  • disptest
    模拟示波器的现实程序,有x,y和光标。采用AD5440输出,现实效果很好。(示波器x-y方式)(Analog oscilloscope reality program, there are x, y and cursor. Using AD5440 output, real good results. (Xy oscilloscope mode))
    2013-09-13 23:18:19下载
    积分:1
  • video_avg33_filter
    图片采用3x3均值滤波,用Verilog语言描述,输入输出分别使用外同步(Pictures are filtered with 3x3 mean and described in Verilog language. Input and output are synchronized with each other.)
    2019-06-03 13:54:54下载
    积分:1
  • mealyfsm sequence detector
    有限状态机(FSM)或有限状态自动机(复数:自动机),或简称状态机,是用于设计计算机程序和时序逻辑电路的计算数学模型。它被认为是一个抽象的机器,可以处于有限个状态之一。机器一次只处于一种状态;它在任何给定时间处于的状态称为当前状态。当tr启动时,它可以从一种状态改变到另一种状态
    2022-01-30 11:45:29下载
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