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zw222
ZardWars Files
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- 2014-03-20 01:43:16下载
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CSCC标准下的RS码译码器的FPGA实现
CSCC标准下的RS(255,223)码的译码器设计，采用verilog语言编程实现，在软件QUARTUS II 9.0环境下仿真通过，并在CYCLONE IV系列开发板调试通过。
- 2022-03-24 22:23:12下载
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vivado-constraints
vivado软件中的时序约束参考资料，很详细，不同的约束种类对应不同的命令。(vivado-using-constraints)
- 2019-05-15 16:20:58下载
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CDCM6208_SPI
说明： 完成对cdcm6208的时钟芯片的配置，输出高频时钟(cdcm6208 cofigure using SPI interface)
- 2021-02-06 18:29:56下载
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gmii_tx_mac
实现千兆以太网数据发送，通过GMII接口向PHY写数据，控制PHY发送数据。(Implementation of Gigabit Ethernet data transmission, write data to the PHY through the GMII interface, control PHY data.)
- 2013-08-08 15:24:43下载
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FPGA_正反_可变步长_计数器
实现了一个3-10步长可变，正反向计数器，已在Spartan3E 250板子上成功实现
- 2022-02-02 19:14:18下载
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展位的乘数的 8 位 Verilog 代码
展位的乘法算法是将在两个的补充符号两个符号二进制数字相乘的乘法算法。展位的算法可以通过反复添加 （与普通的无符号二进制加法） 两个预设值 A 和 S P，然后对体育执行算术右移产品之一让 m 和 r 是被乘数和乘数，分别;让 x 和 y 代表中 m 和 r 位的数目。
- 2022-03-17 20:19:00下载
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ch8_1
8选1程序，是利用vhdl编写的，自己弄得还能用，上传下(8 Select a program is written using vhdl, allowed herself can use to upload the next)
- 2010-06-20 13:36:42下载
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SPI_DAC
使用VHDL语言实现了FPGA与DAC5688进行SPI通信更改寄存器值(The FPGA using VHDL language with the DAC5688 SPI communication to change the register value)
- 2011-10-23 21:14:45下载
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cpu_design
FPGA MIPS架构CPU，五段流水线功能，ISE开发，verilog语言，可综合，模拟结果正确，内含设计报告(FPGA MIPS CPU, simple five-stage pipeline function, developed by ISE, using verilog language)
- 2020-12-03 13:09:25下载
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