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SDRAM读写控制的实现与Modelsim仿真
1. 本实例用于控制开发板上面的SDRAM完成读写功能；先向SDRAM里面写数据，然后再将数据读出来做比较，如果不匹配就通过LED变亮显示出来，如果一致，LED就不亮。2. part1目录是使用Modelsim仿真的工程；3. part2目录是在开发版上面验证的工程；
- 2022-01-30 11:24:06下载
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Interpolator-of-polyphase-filter
代码用两种方法设计了一个基于多相滤波的内插器，低通滤波器采用128阶凯撒窗，内插倍数32，并且给定信号范围，验证了内插器的正确性，画出了内插前后信号的频谱。(The code design the interpolator based on polyphase filter using two methods.The low pass filter is 128 order Caesar window and interpolation multiple is 32.I give the range of the signal to verify the interpolator and plot the spectrum of the signal before and after the interpolator. )
- 2021-01-09 13:18:51下载
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FPGA控制LCD_Panel
本人上网下载下来并调试过的，完全实现NIOS 点亮LCD_Panel，附件是驱动部分。
- 2023-02-05 21:30:03下载
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verilog HDL
DS18B20温度模块，LCD1602显示(DS18B20 Temperature Module, LCD1602 Display)
- 2020-09-04 15:08:06下载
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RTL_NAND_Flash_controller-master
RTL_NAND_Flash_controller-master，基础入门控制器，内存管理，fpga实现。miicron所属，
- 2022-04-12 05:21:10下载
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basys3 官方教程
四个实验带你入门Basys3，快速入门，轻松上手74 系列IP 封装实验示波器实验设计信号发生器实验设计Microblaze 串口实验内附源码
- 2022-03-04 17:04:59下载
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DDR3_256MByte
说明： 基于K7的FPGA的DDR3读写程序，通过串口发送1024位的数据，写到FPGA的DDR3端，然后将数据从DDR3中读取出来，通过串口发送到PC端。(The DDR3 reading and writing program of FPGA based on K7 sends 1024 bit data to DDR3 end of FPGA through serial port, then reads data from DDR3 and sends it to PC through serial port.)
- 2021-02-22 15:19:41下载
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iic master
iic master 通过FPGA验证··成功对eeprom读写操作
clk_div：FPGA 板子分频时钟，满足SCL时钟线速度达400KB
main_state.v：顶层状态机，控制master接口整个工作过程
scl_generator.v:master接口，有SCL状态机产生器和master接口状态机两部分组成
mainsmtb.v：在modelsim环境下的仿真激励
top.v设计顶层模块
- 2022-12-31 21:25:37下载
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forug_2016.03
说明： formality2016 userguide
- 2019-10-29 14:59:40下载
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HART-HT2015
HART 官方资料-HART协议采用基于Bell202标准的FSK频移键控信号，在低频的4-20mA模拟信号上叠加幅度为0.5mA的音频数字信号进行双向数字通讯，数据传输率为1.2kbps。(Official information-HART HART protocol based Bell202 standard frequency shift keying FSK signal at low frequencies 4-20mA analog signal amplitude is 0.5mA superimposed on the two-way audio digital signal digital communication, data transfer rate of 1.2kbps.)
- 2013-07-16 17:23:16下载
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