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labview-filter
数字滤波器包含IIR数字滤波器和FIR数字滤波器。本设计的工作主要是Labview软件部分,包括信号生成模块、滤波模块、显示模块的设计(IIR digital filter comprises a digital filter and FIR digital filters. The design work is mainly Labview software parts, including signal generation module, filter module, display module design)
- 2014-06-05 22:22:37下载
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apb2.0 语言
此建业 2.0 解释建业桥的 i2c 接口的主设备和从设备操作。
建业先进的外围组件包括许多行业常用的接口 IP。以确保可以跨不同范围的 IC 进程迁移的高度可重用的外围设备和系统宏细胞。
- 2023-01-14 06:30:03下载
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系统设计
基于旋转编码器和LED灯组的强度调节系统设计(Design of Intensity Regulation System Based on Rotary Encoder and LED Lamp Set)
- 2020-06-21 02:00:01下载
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PCM
本例设计一个码率为500kb/s,字长为8 位、帧长为128 个字、帧同步码为EB90H 的PCM 采编器。用VHDL语言实现的。(This designs a code to lead for the 500 kbs|s, the word is long for 8, the growing is synchronous code of for 128 words and for the EB90 H of PCM adopt to weave a machine.Use what VHDL language carry out.
)
- 2021-04-23 17:08:47下载
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浮点单元
本文档介绍了Verilog双精度浮点内核,这些
- 2023-03-23 11:50:04下载
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有限状态机
有限状态机的一段式、二段式以及三段式写法的对比
- 2022-02-13 17:05:25下载
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BCD-counter
一个2位的BCD码十进制加法计数器电路,输入为时钟信号CLK,进位
输入信号CIN,每个BCD码十进制加法计数器的输出信号为D、C、B、A和进位输出信号COUT,输入时钟信号CLK用固定时钟,进位输入信号CIN.
(A 2-bit BCD code decimal adder counter circuit input as the clock signal CLK, a carry input signal CIN, D, C, B, A, and the carry output signal COUT, each BCD code decimal adder counter' s output signal, the input clock signal CLK Fixed clock, binary input signal CIN.)
- 2020-10-28 19:29:58下载
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SRAM6bit
sram 6bit仿真模型,verilog编写(sram 6bit simulation model, verilog prepared)
- 2021-03-16 13:59:22下载
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eetop.cn_FPGA数字信号处理实现原理及方法
说明: 本书介绍基于FPGA实现数字信号处理的原理与方法,作为Xilinx公司相关课程的培训教材(The FPGA implementation of DSP principle & method.)
- 2020-06-17 23:20:01下载
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dazhuankuai
基于FPGA设计的经典打砖块小游戏。游戏简单易玩。(FPGA design based on the classic Arkanoid game. Game easy to play.)
- 2013-11-26 09:40:37下载
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