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traffic_lights
用Verilog实现的交通信号灯控制，主干道和支路通行的时间不相等(Using Verilog implementation of traffic signal control, the trunk road and the slip is not the same passage of time)
- 2009-03-28 18:31:31下载
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sdh_pointer_deal
文件描述的是SDH 指针处理和系统同步代码 veriolg(SDH pointer processing and system synchronization code veriolg of file Description)
- 2012-09-07 16:17:40下载
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i2c_master_top
i2c core : i2c master top
- 2012-05-23 01:17:22下载
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DDR_SDRAM控制器verilog代码
使用 Virtex-4 FPGA 器件实现DDR SDRAM控制器
本应用指南描述了在 Virtex™-4 XC4VLX25 FF668 -10C 器件中实现的 DDR SDRAM 控制器。
该实现运用了直接时钟控制技术来实现数据采集，并采用自动校准电路来调整数据线上的延
迟。
DDR SDRAM 器件是低成本、高密度的存储资源，在很多存储器供应商处均可获得。本参考设
计使用 SDRAM 器件和 DIMM 开发而成
- 2023-02-04 16:05:03下载
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doc
e200 riscv open code user guide
- 2020-06-15 22:45:01下载
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Verilog教程-夏宇闻
verilog 教程 PPT版本 语法 结构 设计技巧等(Verilog tutorial PPT version)
- 2018-02-26 11:13:55下载
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Quartus
QuartusII多路选择器,数字电路环境，大三EDA技术实验(Quartus,chosen conductos in matheathics field)
- 2012-10-30 16:26:11下载
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对于功能的宽边测试阵列架构采用Verilog共享的逻辑
应用背景当内置测试生成用于设计，可以划分为逻辑块，它是有利的确定测试具有相似特性的块组，并使用每个组中的块相同的内置测试生成逻辑。本文研究这一问题的一个内置的测试生成方法，产生功能的宽边的测试。功能的宽边的测试是重要的解决延迟故障检测及避免过大的功耗在测试中应用。本文讨论了测试生成的设计一组逻辑块，以及组的选择。关键技术并；宽边的功能测试[ 4 ]确保扫描状态是一个电路可以输入的状态在功能操作，或可到达状态。为宽边测试[ 5 ]，他们在一个初始的时钟周期的两个时钟周期运行的电路扫描状态。这一结果在一二种模式测试中的应用。自状态扫描是一个可到达状态，2个模式测试需要的电路通过状态转换，保证在功能上是可行的运行。检测到的延迟故障也会影响到功能操作，目前的要求不超过那些可能在功能操作过程中。这减轻了过度测试所描述的类型在[ 1 ]中[ 3 ]。此外，在快速功能时钟的功耗功能的宽边测试周期不超过可能在功能操作。
- 2022-10-29 12:55:03下载
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unit5
低频数字式相位测量仪
使用的VHDL语言，在MUXPLUS2环境下使用！
(digit hpase detecter use for low-frequence)
- 2010-05-07 17:00:35下载
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ldpc-for-fpga-decoding
ldpc译码算法的matlab实现，码长960，码率1/2,完全模拟fpga硬件实现语言，量化处理。(ldpc decoding using matalb,code length 960,code rate 1/2)
- 2021-04-12 21:38:56下载
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