登录
首页 » VHDL » 产生伪的VHDL语言程序

产生伪的VHDL语言程序

于 2022-02-05 发布 文件大小:2.21 kB
0 146
下载积分: 2 下载次数: 1

代码说明:

伪随机m序列产生的VHDL语言程序- program in VHDL language for generating pseudo-random m sequence

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 基于FPGA的八位RISC CPU的设计
    基于FPGA的八位RISC CPU的设计-FPGA-based RISC CPU design eight ....
    2022-04-07 11:51:38下载
    积分:1
  • 22WALSH
    1、掌握WALSH码产生的原理和WALSH码的特性。 2、掌握WALSH码的产生和特性分析的软件仿真。 3、掌握WALSH码的硬件产生方法。 (1, master code WALSH WALSH code generation principles and characteristics. 2, master WALSH code generation and characterization of the software simulation. 3, master code WALSH hardware generation approach.)
    2020-07-03 08:40:01下载
    积分:1
  • jiaotongdeng
    十字路口交通灯的单片机控制源代码 红黄绿三灯 还有数码管时间显示(Intersection traffic lights SCM source code red yellow three lights and LED time display)
    2011-08-07 23:34:04下载
    积分:1
  • 这是使用VHDL语言编写的密码锁程序,供大家参考
    这是使用VHDL语言编写的密码锁程序,供大家参考-This is the use of the VHDL code lock preparation procedures for reference
    2023-04-25 08:05:03下载
    积分:1
  • 04_led_test
    FPGA控制外边led,并实现跑马灯等多种效果,用户可以自行控制(FPGA control outside led)
    2020-06-16 09:40:02下载
    积分:1
  • verilog
    基于QUATEUS2的设计一个8位频率计verilog语言编程(The design is based QUATEUS2 an 8-bit frequency counter verilog programming language)
    2011-12-01 20:19:48下载
    积分:1
  • 用verilog实现FSK调制,称为IP核来实现模块…
    用Verilog实现FSK调制,调用IP核实现正弦余弦的调制-Verilog implementation using FSK modulation, called IP core to achieve the modulation sine cosine
    2022-03-15 17:40:05下载
    积分:1
  • modsim仿真必备,可以帮助你解决很多你对软件不熟悉的问题!...
    modsim仿真必备,可以帮助你解决很多你对软件不熟悉的问题!-Simulation modsim necessary, I can help you solve many of the software you are not familiar with the problem!
    2022-04-23 10:16:49下载
    积分:1
  • LCD12864
    verilog lcd2864 适合初学者(verilog lcd2864 )
    2013-10-15 18:57:45下载
    积分:1
  • cycle_measure
    测量周期,此程序已经在EP2C板子上成功实现(mesure cycle)
    2013-08-29 16:09:17下载
    积分:1
  • 696516资源总数
  • 106571会员总数
  • 2今日下载