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Advanced FPGA Design Architecture, Implementation, and Optimization

于 2022-02-05 发布 文件大小:5.70 MB
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Advanced FPGA Design Architecture, Implementation, and Optimization

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  • 可控制器
    应用背景此代码是用于执行器和传感器,可以在网络中实现一个很好的连接与其他节点和主。关键技术VHDL代码 ;可以控制位CRC校验和填料-掩模的验收规范
    2022-01-26 00:30:01下载
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  • pid_controler_latest.tar
    PID控制器的verilog实现,做闭环控制器的人可以参考(PID controller verilog implementation of closed-loop controller may make reference to)
    2010-10-23 17:09:15下载
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  • pprobar
    ES A PRACRICA 2 DEL LABORATORIO DE DIGITAL
    2013-12-09 04:26:42下载
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  • histogram_new
    Verilog语言描述,统计图片的像素值直方图(Verilog,Pictures of the pixel value histogram statistics)
    2021-03-04 17:39:31下载
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  • adder
    This the adder VHDL code, it contains input and output fild, also simulate file-adder
    2022-06-21 18:48:32下载
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  • 用VHDL实现的自动售货机,可供毕业设计参考。
    用VHDL实现自动售货机,可供毕业设计参考。可以输入硬币和纸币,硬币的识别范围是5角和1 元的硬币,纸币的识别范围是1 元、5 元,10 元,20元,50元,100元。可以连续多次投入钱币。可以选择的商品种类有16种,价格分别为1-16元,顾客可以通过输入商品的编号来实现商品的选择。 即有一个小键盘(0-9按键)来完成,比如输入15时要先输入1,再输入5。顾客选择完商品后,可以选择需要的数量。每次可以选择最多三个商品。然后显示出所需金额和已投币总币值。在投币期间,顾客可以按取消键取消本次操作,钱币自动退出。
    2023-04-12 13:35:05下载
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    步进电机位置系统 步进电机位置系统block symbol file 步进电机位置系统的Verilog HDL程序设计 已编译通过-Stepper motor stepper motor position location system system block symbol file location stepper motor system Verilog HDL program design has been compiled through
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  • stm32-and-fpga-communication-by-spi
    该实验完成的功能是STM32与FPGA通信(The function of the experiment is STM32 and FPGA communication)
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    脉冲多普勒雷达回波信号相干积累的VHDL源程序-pulse Doppler radar echo signal coherent accumulation of VHDL source
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    用FPGA实现IIC通讯的主控端,最简化的代码,占用最小FPGA资源-Use FPGA to come ture the main control of the iic comunication, the most simple code and using the least FPGA resource
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