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verilog 设计流水灯

于 2022-02-11 发布 文件大小:262.37 kB
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代码说明:

流水灯在Verilog语言下的分模块设计。分别是时钟脉冲+计数器+LED控制

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  • con1
    4 bit convoltion with vhdl.
    2011-10-18 18:18:09下载
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  • myTurbo_test
    Turbo编码的FPGA实现,采用了(7,5)RSC编码和循环移位交织,帧长度128bit(The FPGA implementation of Turbo coding adopts (7, 5) RSC coding and cyclic shift interleaving, and the frame length is 128bit.)
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  • 32位D触发器
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    2022-05-26 03:43:04下载
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  • cpu_easy
    说明:  ADD MOV MOVi SUB四指令cpu设计,qutartus,(Design of four-instruction CPU)
    2019-05-13 11:44:49下载
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  • IDT7005
    双端口静态RAM的VHDL程序,具体芯片型号为IDT7005(DUAL-PORT STATIC RAM)
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  • vhdl4
    VHDL Language Reference courses part4
    2010-02-10 00:52:53下载
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  • ethernet_100
    Verilog,编写的udp收发程序,开发环境xilinx(Verilog, written UDP transceiver)
    2020-10-29 21:09:57下载
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