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LCD1602 verilog
LCD1602显示源码，verilog编写，已在版上测试过！可输入字符串显示！！！！！！！！
- 2023-06-25 09:20:04下载
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基于fpga的自动售货机
用verilog状态机实现的自动售货机，是一次课程作业，参考了网上的例子进行了修改(Automatic vending machine implemented with Verilog state machine)
- 2018-06-25 22:18:06下载
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LDPC_en-decoder-master
说明： LDPC的编解码的实现，适合初学者学习，大家可以多交流(The implementation of LDPC Encoding and decoding is suitable for beginners to learn)
- 2021-04-21 16:18:49下载
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DE2_NIOS_HOST_MOUSE_VGA
基于nios的vga显示实验，自制的ip核。可以按照自己的需求改写ip(Nios to vga display ip nuclear experiments, homemade. Can be rewritten in accordance with their own needs ip)
- 2021-04-11 11:58:58下载
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PID controller verilog源代码
The PID controller IP core performs digital proportional–integral–derivative controller (PID controller) algorithm. The algorithm first calculates the error between a measured value (PV) and its ideal value (SP), then use the error as an argument to calculate the manipulate value(MV). The MV will adjust the process to minimize the error. It can be used to calculate duty cycle for PWM (Pulse Width Modulation).
- 2022-09-23 12:05:03下载
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xilinx-FPGA
xilinx FPGA技术详解,从设计流程到设计注意点(xilinx FPGA technology Detailed Design points, from the design process to)
- 2012-08-10 13:07:41下载
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DDR SDRAM控制器verilog代码及中文说明文档
本应用指南描述了在 Virtex™-4 XC4VLX25 FF668 -10C 器件中实现的 DDR SDRAM 控制器。该实现运用了直接时钟控制技术来实现数据采集，并采用自动校准电路来调整数据线上的延迟。DDR SDRAM 器件是低成本、高密度的存储资源，在很多存储器供应商处均可获得。本设计使用 SDRAM 器件和 DIMM 开发而成。
- 2023-01-24 23:25:04下载
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divider
用VERILOG实现一个被除数为8位、除数为4位的高效除法器(With VERILOG implement a dividend for the 8-bit, 4-bit effective divisor divider)
- 2020-11-19 11:39:37下载
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rs_enc
Verilog code for RS-(255,239) encoder.
- 2021-04-06 16:19:02下载
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lpddr2
LPDDR2 SDRAM memories compliant to JEDEC JESD209-2.
- 2015-05-11 20:57:21下载
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