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于 2022-03-12 发布文件大小:104.34 kB

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代码说明：

在一些系统中，经常用到对触发信号延时一段时间后，再对某些目标信号进行采集，通常这段延时要求非常精确，还要做到范围可调，一般这种延时的最小时间单位小于100ns。如果选用普通微控制器，延时系统的操作界面比较容易实现，但是靠软件延时得到结果的准确性较低。考虑到芯片功能、开发环境以及接口方便等问题，最终选用一片常用的AlteraSVCPLD EPM7128SLC3411]作为系统的核心控制部分，来实现信号延时、输人设定、运行显示的功能。应用Veril- o苦2〕语言，在Altera的Quartus11WebEditio详3〕软件环境下进行编程仿真，最后烧写芯片进行系统硬件测试 -err

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shuzishizhong
这是基于verilog hdl的数字时钟源代码，能够实现时分秒的计时，可以手动进行调时与调分。(This is based on the digital clock verilog hdl source code, can be achieved when every minute of the time, you can adjust the time manually adjusting points.)

2013-12-10 22:21:55下载

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flash
fpga Verilog 控制读写flash (fpga Verilog flash )

2015-06-23 14:45:44下载

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该文件用在CPLD上的，和C语言很接近，5位的计数器一个。
该文件用在CPLD上的，和C语言很接近，5位的计数器一个。-the documents on the CPLD, and the C language is close to that of the five counters one.

2023-04-25 23:35:03下载

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facman
一款在Verilog实现的吃豆人游戏，采用VGA接口，在Nexys3开发板上运行无误。(A pac-man game implemented via Verilog, using VGA interface, perfectly run on Nexys 3)

2021-03-31 07:39:09下载

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I121-v1.10
Implementation of Serial Infrared decoder for low-speed IrDA communications.

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FPGA向SRAM中写入数据，VHDL编程-FPGA to the SRAM write data, VHDL programming

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FPGA based design and Implementation of Advanced Encryption Standard

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FPGA实现乒乓球游戏代码及仿真 VGA实现(FPGA realizes table tennis game code and simulation VGA implementation)

2019-05-06 20:22:13下载

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vhdl um teste com muita coisa interessante ae pra ver

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XAPP200_ddr_sdram_64b
Xapp 200 64 bit DDR SDRAM design files for Xilinx Vertix

2011-01-19 09:45:06下载

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