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基于 Fpga 的高速 8 位吠陀乘法器

于 2022-03-20 发布 文件大小:11.38 kB
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代码说明:

本文介绍了 8 位Vedic乘法器提升传播执行延迟,当相比传统的乘数,像阵列乘法器、 布劳恩乘数、 改性的 booth  型乘法器和华莱士树型乘法器

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  • kbfp
    实现任意整数倍的信号分频,可调,不存在毛刺,波形完整,可运于信号的分析与检测(Arbitrary integer multiple of the signal frequency, adjustable, there is no glitch, waveform integrity, and can transport the analysis and the detection signal)
    2015-08-14 22:58:22下载
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  • verilog 控制ad7705读写
    ad7705通过spi时序进行读写,通过fpga模拟spi时序对adc进行读写,首先写入通信寄存器20h,时钟寄存器0C,通信寄存器10,设置寄存器40H,然后写通信寄存器进行读取。
    2022-02-05 07:27:37下载
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  • alu
    this is the vhdl code for the arithmetic logic unit.enjoy!
    2013-08-22 18:51:35下载
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  • 66_AD_test(1)
    EV10AQ190A配置程序 EV10AQ190A configuration program(EV10AQ190A configuration program)
    2021-03-27 00:09:12下载
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  • MIPS32五级流水线CPU Verilog代码,注释清晰,供学习
    应用背景 Verilog 实现 MIPS32 V1整数指令集, 5级流水线CPU 没有文档,按照流水线划分模块,代码注释多,便于理解。FPGA验证通过,可综合。 关键技术五级流水线MIPS处理器verilog源码,实现MIPS32的整数指令,代码风格好,注释清晰,适用于计算机体系结构的理解及实践,了解MIPS体系结构有很大帮助
    2022-04-16 11:12:47下载
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  • 27个FPGA实例源代码
    一些对初学者比较实用的源码,ASK,PSK,FSK调制解调(Some of the more practical source code for beginners)
    2020-12-10 16:29:20下载
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  • clock_6
    ds1302时钟驱动程序,已在quartus上验证可以是直接使用(DS1302 clock driver, which has been verified on quartus, can be used directly)
    2020-06-24 12:00:02下载
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  • 16QAM调制与解调的FPGA实现
    该源代码是实现14路并行的16QAM的调制,以及解调,其中还包含测试文件,已经在altera FPGA上面实现了其正确性,可以直接拿来使用。
    2022-06-11 17:29:04下载
    积分:1
  • FPGA
    Verilog 我认为写的非常好的细节书(Verilog In my opinion written details of the book)
    2012-10-03 10:10:46下载
    积分:1
  • spi_dac_ad7394_ad7395.v
    Verilog code of SPI configurator for DAC AD7394 and AD7395
    2014-09-11 21:58:15下载
    积分:1
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