通过大量数字交换数据生成新的信息安全需求。用户期望的健壮的解决方案将确保法，还保证多媒体文件的真实性。此项目的图像水印算法usingLeast有效位（LSB）算法被用于信息/徽标中嵌入图像。设计过程进行theXilinxISE设计套件12.4和硬件描述语言使用isVHDL。模拟设计和波形在Isim(M.81d)模拟器中得到验证。一旦完成了设计过程，设计但在Spartan3FPGA板。带水印的图像是在goodvisual的质量并具有好的PSNR值。同时可见并推行invisiblewatermarking计划。建议schemehas的有效性已表现出与实验结果的援助。Watermarkingis更可靠、更经济比软件编码的硬件实现。在空间域中最常见的简单watermarkingtechnique是通过操纵最不重要位（lsb）整体像素为单位）。要嵌入的水印放置在碱基图像的LSB。空间域是不太复杂，没有变换使用，但isn"trobust数字式图像中的攻击，信息可以直接插入imageinformation的每一点或更繁忙地区的图像可以计算这样以中不那么明显的图像部分的hidesuch消息-IMDN开发者社群-imdn.cn"> 通过大量数字交换数据生成新的信息安全需求。用户期望的健壮的解决方案将确保法，还保证多媒体文件的真实性。此项目的图像水印算法usingLeast有效位（LSB）算法被用于信息/徽标中嵌入图像。设计过程进行theXilinxISE设计套件12.4和硬件描述语言使用isVHDL。模拟设计和波形在Isim(M.81d)模拟器中得到验证。一旦完成了设计过程，设计但在Spartan3FPGA板。带水印的图像是在goodvisual的质量并具有好的PSNR值。同时可见并推行invisiblewatermarking计划。建议schemehas的有效性已表现出与实验结果的援助。Watermarkingis更可靠、更经济比软件编码的硬件实现。在空间域中最常见的简单watermarkingtechnique是通过操纵最不重要位（lsb）整体像素为单位）。要嵌入的水印放置在碱基图像的LSB。空间域是不太复杂，没有变换使用，但isn"trobust数字式图像中的攻击，信息可以直接插入imageinformation的每一点或更繁忙地区的图像可以计算这样以中不那么明显的图像部分的hidesuch消息 - IMDN开发者社群-imdn.cn">

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lsb 基于可见和不可见数字水印

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vb3draw
这是一个讲究的的介绍VB在犀牛软件里的很好的东西你会满意的相信我(you will be glad)

2013-11-28 14:32:37下载

积分：1
01_rtc_ds1302
说明：实现基于黑金开发板的实时时钟功能，显示时分秒(Realize the real-time clock function based on black gold development board, display time, minute and second)

2021-01-11 14:40:12下载

积分：1
digital_piano-VHDL
使用VHDL编写数字蜂鸣器音乐，整个项目文件，可直接使用 (Use VHDL to write 1602led driver, the entire project file, and can be used directly.)

2020-12-27 22:49:03下载

积分：1
doorlock
基于FPGA设计的电子密码锁是一个小型的数字系统，与普通机械锁相比，具有许多独特的优点：保密性好，防盗性强，可以不用钥匙，记住密码即可开锁等。(FPGA-based design of the electronic code lock is a small digital system. It has many unique advantages：good privacy and security , it do not need the key but remember password to unlock, and so on while it compare to ordinary mechanical locks.)

2013-12-25 21:24:41下载

积分：1
avnet_edk12_4_xbd_files
安富利SP605开发板ISE12.4版本的XBD文件，里面包括了开发板所有的接口，包括硬件和软件设计(Avnet SP605 development board ISE12.4 version XBD file, which includes the development board all interfaces, including hardware and software design)

2014-04-20 21:56:05下载

积分：1
CPU
使用verilog作为CPU设计语言实现单数据通路五级流水线的CPU。具有32个通用寄存器、一个程序计数器PC、一个标志寄存器FLAG，一个堆栈寄存器STACK。存储器寻址粒度为字节。数据存储以32位字对准。采用32位定长指令格式，采用Load/Store结构，ALU指令采用三地址格式。支持有符号和无符号整数加、减、乘、除运算，并支持浮点数加、减、乘、除四种运算，支持与、或、异或、非4种逻辑运算，支持逻辑左移、逻辑右移、算术右移、循环右移4种移位运算，支持Load/Store操作，支持地址/立即数加载操作，支持无条件转移和为0转移、非0转移、无符号>转移、无符号<转移、有符号>转移、有符号<转移等条件转移。()

2008-06-02 16:34:00下载

积分：1
this document is in two MAXplusII environment through the development and operat...
此两文件是在MAXplusII环境下开发并运行通过的VHDL文件，实现了并串口转换功能。-this document is in two MAXplusII environment through the development and operation of the VHDL documents, and the realization of serial conversion function.

2022-02-26 14:17:56下载

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TimeGen3
能够绘制数字电路的时序图，是fpga工程师时序设计和分析的神器(for digital circuit timming design and analysis)

2017-12-27 19:34:23下载

积分：1
VHDL
EDA技术以EDA软件工具为开发环境，以可编程逻辑器件为实验载体，实现源代码编程和仿真功能。VHDL作为一种标准化的硬件描述语言用于描述数字系统的结构、行为、功能和接口。本设计提出了一种基于VHDL语言的编码器和译码器的实现方法。编码器与译码器是计算机电路中基本的器件，本课程设计采用EDA技术设计编码和译码器。编码器由8线-3线优先编码器作为实例代表，译码器则包含3线-8线译码器和2线-4线译码器两个实例模块组成。课程设计采用硬件描述语言VHDL把电路按模块化方式进行设计，然后进行编程、时序仿真和分析等。课程设计结构简单，使用方便，具有一定的应用价值。 (EDA technology take the EDA software as tools for the development of the environment,programmable logic devices in experimental carrier,the realiztion of the source code programming and simulation. The VHDL as a standardized hardware description language used to describe the struction of digital systems,behavior,function and interface. The paper proposes a method for encoder and decoder based on the VHDL language.Encoder and decoder is a basic computer circuit devices.This Curriculum design by EDA design encoder and decoder.Encoders from 8- 3 priority encoder for example,and decoder includes 3- 8 decoder and the 2- 4 examples of the two decoder modules.And then to program, the timing simulation and analysis.Curriculum design, simple structure, easy to use and has a value.)

2011-06-22 21:23:30下载

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FPGA_27eg
FPGA很有价值的27实例.rar 包括 LED控制VHDL程序与仿真 2004.8修改.doc； LED控制VHDL程序与仿真； LCD控制VHDL程序与仿真 2004.8修改； LCD控制VHDL程序与仿真； ADC0809 VHDL控制程序； TLC5510 VHDL控制程序； DAC0832 接口电路程序； TLC7524接口电路程序； URAT VHDL程序与仿真； ASK调制与解调VHDL程序及仿真； FSK调制与解调VHDL程序及仿真； PSK调制与解调VHDL程序及仿真； MASK调制VHDL程序及仿真； MFSK调制VHDL程序及仿真； MPSK调制与解调VHDL程序与仿真；基带码发生器程序设计与仿真；频率计程序设计与仿真；采用等精度测频原理的频率计程序与仿真；电子琴程序设计与仿真 2004.8修改；电子琴程序设计与仿真；电梯控制器程序设计与仿真；电子时钟VHDL程序与仿真；自动售货机VHDL程序与仿真；出租车计价器VHDL程序与仿真 2004.8修改；出租车计价器VHDL程序与仿真；波形发生程序；步进电机定位控制系统VHDL程序与仿(FPGA value of the 27 examples. Rar including LED control procedures and VHDL simulation 200 4.8 amendments. doc; LED control procedures and VHDL simulation; LCD control procedures and VHDL simulation 2004.8 modified; LCD control procedures and VHDL simulation; Connection between ADC 0809 VHDL control procedures; TLC5510 VHDL control procedures; DAC0832 interface circuits; TLC7524 interface circuits; URAT procedures and VHDL simulation; ASK modulation and demodulation process and VHDL simulation; FSK modulation and demodulation process and VHDL simulation; PSK modulation and demodulation process and VHDL simulation; MASK modulation procedures and VHDL simulation; MFSK modulation procedures and VHDL simulation; MPSK modulation and demodulation process and VHDL simulation; Base-band code gene)

2020-06-26 05:40:02下载

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