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DA_AD
基于FPGA的AD和DA设计代码及文档(Design code and document of AD and DA based on FPGA)
- 2017-11-07 22:03:30下载
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将Rs232转化为Rs485
前面上传了一个RS485通信的Verilog代码，这一个是另外一种方式实现RS485通信的Verilog代码。通过多种代码对比，有利于设计需要的电路。此外由于软件的不同，需要利用源码，在自己的软件上新建工程文件，实现运行，仿真
- 2022-10-14 17:40:04下载
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AHB_UVC_and_AHB_IC_Verificat
ahb uvc is an on chip communication protocol for high speed integration and low power utilities performance protocols widely used in all vip applications
- 2020-10-21 12:07:24下载
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电路四倍频算法
说明： 电路四倍频算法，具有去毛刺，整形功能，方向及计数(Circuit quadruple frequency algorithm, with deburring, shaping function)
- 2020-06-20 01:00:02下载
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freq_meter
使用verilog写的频率计，可切换档位(Frequency counter using verilog write switch stalls)
- 2012-12-08 00:54:56下载
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apb.v
AMBA总线apb总线的verilog代码以及相关的中断控制。(AMBA bus apb bus verilog code and associated interrupt control.)
- 2021-04-17 20:38:53下载
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sales.zip
自动售货机，与现实生活中的售货机功能类似，可以自动进行找零(Vending machines, vending machines and similar real life, there is a function to automatically calculate the price of goods)
- 2015-03-30 14:27:52下载
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基于dds的波形发生器
说明： DDS的基本原理主要由五部分组成，分别是；相位累加器，正弦波形存储器，数模转换器，低通滤波器和时钟，将相位累加器输出的数据作为地址，用来查询表的数据，将取出的正弦数据通过数模转换器输出模拟信号，模拟信号再通过一个低通滤波器输出纯净的正弦波信号。(The basic principle of DDS is mainly composed of five parts: phase accumulator, sinusoidal waveform memory, digital to analog converter, low-pass filter and clock. The output data of phase accumulator is used as address to query the data of table. The extracted sinusoidal data is output analog signal through digital analog converter, and the analog signal is output pure sine through a low-pass filter Wave signal.)
- 2020-09-16 23:34:30下载
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简单的CPU（源代码和合成脚本）
应用背景此文件包含所有的源代码和脚本，以Altera公司的简单CPU的合成。500MHz时钟设计运行。 ；关键技术使用CLA提高速度的设计。这只是一个简单的CPU，它的结构很简单，它没有任何管道或类似的东西。
- 2022-04-30 14:14:37下载
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uaf42
使用uaf42设计的有源滤波器，高通滤波器的设计参数记录(Using uaf42 design active filters, high-pass filter design parameters recorded)
- 2012-09-09 21:49:49下载
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