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frequency-digital-phase-measuring-
低频数字式相位测量仪,数码管显示相位差,精度为0.1(Low frequency digital phase measuring instrument, digital pipe display phase difference
)
- 2011-08-10 00:45:49下载
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nand 闪存仿真模型
用于IC芯片设计验证仿真的nand flash芯片模型;包括模型及测试平台,对于进行nand flash控制器设计或者验证人员非常有帮助!另外,附上与之对应的镁光的芯片说明文档,见pdf附件
- 2022-01-21 18:06:52下载
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data_rom
正弦信号发生器,用VHDL来完成,抗干扰能力较强,(Sinusoidal signal generator, using VHDL to accomplish, a strong anti-interference ability,)
- 2009-07-15 22:44:02下载
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DDR3_user_design
在Xilinx开发环境ISE13.2上用MIG产生的DDR3 SDRAM控制器,里面生成了Core,可用于DDR3读写控制(On the Xilinx development environment ISE13.2 generated with MIG DDR3 SDRAM controller, which generates the Core, DDR3 can be used to read and write control)
- 2012-02-02 15:16:00下载
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IIC驱动 verilog
IIC驱动 verilog代码 !!!!!!!!!!!!!
开发板测试正常!!!!!!!!!!!!!!!!!
- 2023-05-23 02:30:03下载
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DE2_115_Synthesizer
FPGA implementation of simple Multi-tone Electronic Keyboard using DE2-115 board with a PS/2 keyboard and speaker
- 2013-08-20 19:48:32下载
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DDS_AD9910
说明: 用 AD9910实现的DDS 线性调频信号,调试已通过 可以使用(DDS LFM signal realized by ad9910 has passed debugging and can be used)
- 2019-10-23 15:36:06下载
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基于FPGA的ASN.1编码单元的通用解码模块
本设计旨在实现一种硬件解码模块,这种解码针对ASN.1基本编码规则下的APDU的数据。这种解码模块可以应用在符合GB61850-8-1和GB61850-9-2标准下的GOOSE和SV的MAC层
帧的解码。
本设计亦可以解码通用的ASN.1基本编码规则下的TLV数据流。数据的TAG要求值不大于30,数据的长度范围为1≦LENGTH≦2047,TLV的层级结构不大于4级,整体的数据长度不大于2047。如果需要更大的解码能力则需要修改设计以满足需求。
- 2022-03-31 01:09:41下载
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Memory Slave
&此程序用于读取和写入计算机内存。内存从机使用verilog编程语言。它可以通过ISE Design Suite 14.2(Xilinx)运行
- 2022-03-21 02:40:44下载
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LCD1602 verilog
LCD1602显示源码,verilog编写,已在版上测试过!可输入字符串显示!!!!!!!!
- 2023-06-25 09:20:04下载
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